(A
參數(shù)資料
型號： AD9854ASTZ
廠商： Analog Devices Inc
文件頁數(shù)： 49/52頁
文件大小： 0K
描述： IC DDS QUADRATURE CMOS 80-LQFP
產(chǎn)品培訓(xùn)模塊： Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
Direct Digital Synthesizer Tutorial Series (7 of 7): DDS in Action
Direct Digital Synthesis Tutorial Series (3 of 7): Angle to Amplitude Converter
Direct Digital Synthesis Tutorial Series (6 of 7): SINC Envelope Correction
Direct Digital Synthesis Tutorial Series (4 of 7): Digital-to-Analog Converter
Direct Digital Synthesis Tutorial Series (2 of 7): The Accumulator
標準包裝： 1
分辨率（位）： 12 b
主 fclk： 300MHz
調(diào)節(jié)字寬（位）： 48 b
電源電壓： 3.14 V ~ 3.47 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 80-LQFP
供應(yīng)商設(shè)備封裝： 80-LQFP（14x14）
包裝： 托盤
產(chǎn)品目錄頁面： 552 (CN2011-ZH PDF)
配用： AD9854/PCBZ-ND - BOARD EVAL FOR AD9854
AD9854
Rev. E | Page 6 of 52
AD9854ASVZ
AD9854ASTZ
Parameter
Temp
Test
Level
Min
Typ
Max
Min
Typ
Max
Unit
Residual Phase Noise
(AOUT = 5 MHz, External Clock = 30 MHz
REFCLK Multiplier Engaged at 10×)
1 kHz Offset
25°C
V
140
dBc/Hz
10 kHz Offset
25°C
V
138
dBc/Hz
100 kHz Offset
25°C
V
142
dBc/Hz
(AOUT = 5 MHz, External Clock = 300 MHz,
REFCLK Multiplier Bypassed)
1 kHz Offset
25°C
V
142
dBc/Hz
10 kHz Offset
25°C
V
148
dBc/Hz
100 kHz Offset
25°C
V
152
dBc/Hz
PIPELINE DELAYS4, 5, 6
DDS Core (Phase Accumulator and
Phase-to-Amp Converter)
25°C
IV
33
SYSCLK cycles
Frequency Accumulator
25°C
IV
26
SYSCLK cycles
Inverse Sinc Filter
25°C
IV
16
SYSCLK cycles
Digital Multiplier
25°C
IV
9
SYSCLK cycles
DAC
25°C
IV
1
SYSCLK cycles
I/O Update Clock (Internal Mode)
25°C
IV
2
SYSCLK cycles
I/O Update Clock (External Mode)
25°C
IV
3
SYSCLK cycles
MASTER RESET DURATION
25°C
IV
10
SYSCLK cycles
COMPARATOR INPUT CHARACTERISTICS
Input Capacitance
25°C
V
3
pF
Input Resistance
25°C
IV
500
kΩ
Input Current
25°C
I
±1
±5
±1
±5
μA
Hysteresis
25°C
IV
10
20
10
20
mV p-p
COMPARATOR OUTPUT CHARACTERISTICS
Logic 1 Voltage, High-Z Load
Full
VI
3.1
V
Logic 0 Voltage, High-Z Load
Full
VI
0.16
V
Output Power, 50 Ω Load, 120 MHz Toggle Rate
25°C
I
9
11
9
11
dBm
Propagation Delay
25°C
IV
3
ns
Output Duty Cycle Error7
25°C
I
10
±1
+10
10
±1
+10
%
Rise/Fall Times, 5 pF Load
25°C
V
2
ns
Toggle Rate, High-Z Load
25°C
IV
300
350
300
350
MHz
Toggle Rate, 50 Ω Load
25°C
IV
375
400
375
400
MHz
Output Cycle-to-Cycle Jitter8
IV
4.0
ps rms
COMPARATOR NARROW-BAND SFDR9
10 MHz (±1 MHz)
25°C
V
84
dBc
10 MHz (±250 MHz)
25°C
V
84
dBc
10 MHz (±50 MHz)
25°C
V
92
dBc
41 MHz (±1 MHz)
25°C
V
76
dBc
41 MHz (±250 MHz)
25°C
V
82
dBc
41 MHz (±50 MHz)
25°C
V
89
dBc
119 MHz (±1 MHz)
25°C
V
73
dBc
119 MHz (±250 MHz)
25°C
V
73
dBc
119 MHz (±50 MHz)
25°C
V
83
dBc
CLOCK GENERATOR OUTPUT JITTER9
5 MHz AOUT
25°C
V
23
ps rms
40 MHz AOUT
25°C
V
12
ps rms
100 MHz AOUT
25°C
V
7
ps rms
相關(guān)PDF資料
PDF描述
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