AOUT
參數(shù)資料
型號(hào)： AD9854ASTZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 10/52頁(yè)
文件大小： 0K
描述： IC DDS QUADRATURE CMOS 80-LQFP
產(chǎn)品培訓(xùn)模塊： Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
Direct Digital Synthesizer Tutorial Series (7 of 7): DDS in Action
Direct Digital Synthesis Tutorial Series (3 of 7): Angle to Amplitude Converter
Direct Digital Synthesis Tutorial Series (6 of 7): SINC Envelope Correction
Direct Digital Synthesis Tutorial Series (4 of 7): Digital-to-Analog Converter
Direct Digital Synthesis Tutorial Series (2 of 7): The Accumulator
標(biāo)準(zhǔn)包裝： 1
分辨率（位）： 12 b
主 fclk： 300MHz
調(diào)節(jié)字寬（位）： 48 b
電源電壓： 3.14 V ~ 3.47 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 80-LQFP
供應(yīng)商設(shè)備封裝： 80-LQFP（14x14）
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 552 (CN2011-ZH PDF)
配用： AD9854/PCBZ-ND - BOARD EVAL FOR AD9854
AD9854
Rev. E | Page 18 of 52
CLOCK OUT = 200MHz
LPF
SIN
LPF
AD9854
COS
REFERENCE
CLOCK
COMPARATORS
AOUT = 100MHz
00
6
36
-03
3
Figure 33. Clock Frequency Doubler
PROCESSOR/
CONTROLLER
FPGA, ETC.
RSET
8-BIT PARALLEL OR
SERIAL PROGRAMMING
DATA AND CONTROL
SIGNALS
AD9854
+
REFERENCE
CLOCK
300MHz MAX DIRECT
MODE OR 15MHz TO 75MHz
MAX IN THE 4× TO 20×
CLOCK
MULTIPLIER MODE
2k
I DAC
1
2
Q DAC OR
CONTROL
DAC
LOW-PASS
FILTER
LOW-PASS
FILTER
00
636
-034
NOTES
1. IOUT = APPROX 20mA MAX WHEN RSET = 2k.
2. SWITCH POSITION 1 PROVIDES COMPLEMENTARY
SINUSOIDAL SIGNALS TO THE COMPARATOR
TO PRODUCE A FIXED 50% DUTY CYCLE FROM THE
COMPARATOR.
3. SWITCH POSITION 2 PROVIDES THE SAME DUTY CYCLE
USING QUADRATURE SINUSOIDAL SIGNALS TO THE
COMPARATOR OR A DC THRESHOLD VOLTAGE TO
ALLOW SETTING OF THE COMPARATOR DUTY CYCLE
(DEPENDS ON THE CONFIGURATION OF THE Q DAC).
CMOS LOGIC CLOCK OUT
Figure 34. Frequency Agile Clock Generator Applications for the AD9854
相關(guān)PDF資料
PDF描述
AD9858BSVZ IC DDS DAC 10BIT 1GSPS 100-TQFP
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AD9882KSTZ-140 IC INTERFACE/DVI 100MHZ 100LQFP
AD9883ABSTZ-RL140 IC INTERFACE FLAT 140MHZ 80LQFP
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參數(shù)描述
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