tRDHOZ t
參數(shù)資料
型號(hào)： AD9854ASTZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 29/52頁(yè)
文件大小： 0K
描述： IC DDS QUADRATURE CMOS 80-LQFP
產(chǎn)品培訓(xùn)模塊： Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
Direct Digital Synthesizer Tutorial Series (7 of 7): DDS in Action
Direct Digital Synthesis Tutorial Series (3 of 7): Angle to Amplitude Converter
Direct Digital Synthesis Tutorial Series (6 of 7): SINC Envelope Correction
Direct Digital Synthesis Tutorial Series (4 of 7): Digital-to-Analog Converter
Direct Digital Synthesis Tutorial Series (2 of 7): The Accumulator
標(biāo)準(zhǔn)包裝： 1
分辨率（位）： 12 b
主 fclk： 300MHz
調(diào)節(jié)字寬（位）： 48 b
電源電壓： 3.14 V ~ 3.47 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 80-LQFP
供應(yīng)商設(shè)備封裝： 80-LQFP（14x14）
包裝： 托盤
產(chǎn)品目錄頁(yè)面： 552 (CN2011-ZH PDF)
配用： AD9854/PCBZ-ND - BOARD EVAL FOR AD9854
AD9854
Rev. E | Page 35 of 52
A<5:0>
D<7:0>
A1
D1
A2
D2
A3
D3
tRDHOZ
tRDLOV
tAHD
tADV
SPECIFICATION
VALUE
DESCRIPTION
tADV
tAHD
tRDLOV
tRDHOZ
15ns
5ns
15ns
10ns
ADDRESS TO DATA VALID TIME (MAXIMUM)
ADDRESS HOLD TIME TO RD SIGNAL INACTIVE (MINIMUM)
RD LOW TO OUTPUT VALID (MAXIMUM)
RD HIGH TO DATA THREE-STATE (MAXIMUM)
RD
006
36
-05
2
Figure 52. Parallel Port Read Timing Diagram
D<7:0>
D1
D2
D3
SPECIFICATION
VALUE
DESCRIPTION
tASU
tDSU
tADH
tDHD
8.0ns
3.0ns
ADDRESS SETUP TIME TO WR SIGNAL ACTIVE
DATA SETUP TIME TO WR SIGNAL ACTIVE
0ns
ADDRESS HOLD TIME TO WR SIGNAL INACTIVE
DATA HOLD TIME TO WR SIGNAL INACTIVE
tWRLOW
tWRHIGH
tWR
2.5ns
WR SIGNAL MINIMUM LOW TIME
7ns
10.5ns
WR SIGNAL MINIMUM HIGH TIME
MINIMUM WRITE TIME
A<5:0>
A1
A2
A3
tASU
tAHD
tWRHIGH
tWRLOW
tDHD
tDSU
tWR
WR
0
06
36-
0
53
Figure 53. Parallel Port Write Timing Diagram
相關(guān)PDF資料
PDF描述
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