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參數(shù)資料
| 型號： | 935274744557 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類： | 消費家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 封裝： | 27 X 27 MM, 1.75 MM HIEGHT, PLASTIC, MS-034, BGA-456 |
| 文件頁數(shù)： | 510/828頁 |
| 文件大?。?/td> | 7748K |
| 代理商： | 935274744557 |
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Philips Semiconductors
PNX15xx Series
Volume 1 of 1
Chapter 18: SPDIF Input
PNX15XX_SER_3
Koninklijke Philips Electronics N.V. 2006. All rights reserved.
Product data sheet
Rev. 3 — 17 March 2006
18-2
storage in main memory using a hardware double buffered scheme. In addition,
during the decode phase, the input stream is processed to extract parity, validity and
selected channel status information for each IEC60958 block.
The SPDIF bitstream is composed of a single signal that is organized into a block
structure of 192 frames. The signal has both data and an embedded clock present.
Each frame is composed of 2 subframes each composed of 32 bits. The stream is
encoded with a line code called “bi-phase mark” encoding. Figure 2 shows the
organization of the IEC60958 SPDIF stream format.
The input stream is parsed by the hardware using an extracted bitclock that is
synchronous to the oversampling clock. The audio data, validity ag, channel status
and parity bits are extracted and the SPDI_STATUS and SPDI_CBITS registers are
updated, see Figure 9. The audio portion of each subframe can contain samples that
are up to 24 bits in length.
2.2 Architecture
2.2.1
Functional Modes
The SPDIF Input module has 3 major functional modes. All modes are congured via
software programmable MMIO registers, see Figure 9. These modes are:
16-bit Mode: Subframe bits [27:12] inclusive are selected and stored. All biphase
encoded bits are decoded. In addition, the state of the parity bit and the validity
bit of each subframe is sampled and the SPDI_STATUS register is updated with
the results. This mode is useful when the stream contains either 16-bit PCM
audio or 16-bit non-PCM samples.
32-bit Mode: Subframe bits [27:4] inclusive are selected and stored subject to a
programmable bitmask. A 32-bit word is formed by padding ‘0’ bits to the
least
signicant end of the masked audio samples. In addition, the state of the parity bit
and the validity bit of each subframe is sampled and the SPDI_STATUS register is
updated with the results. This mode provides for any audio sample size ranging from
17 to 24 bits.
Figure 1:
SPDIF Input Block Diagram
SPDI_IN
SPDIF
Input
32
DATA
SPDIF
Input
pin
Oversampling clock
domain
MTL Bus
to External memory
Memory
clock domain
Registers
Control
dtl_mmio_clk
domain
DMA UNIT
相關PDF資料 |
PDF描述 |
|---|---|
| 935277746557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 935277748557 | SPECIALTY CONSUMER CIRCUIT, PBGA456 |
| 9353-2523-002 | PANEL MOUNT, CABLE TERMINATED, FEMALE, SMA CONNECTOR, CRIMP, JACK |
| 93568-151100 | INTERCONNECTION DEVICE |
| 93575-090001 | INTERCONNECTION DEVICE |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| 935275527134 | 制造商:NXP Semiconductors 功能描述:IC BUS SWITCH OCTAL QUAD 20TSSOP |
| 935277864112 | 制造商:NXP Semiconductors 功能描述:IC CPU |
| 935278818112 | 制造商:NXP Semiconductors 功能描述:LCD DRVR 20DIGIT 2.5V/3.3V/5V 56-Pin VSO Tube |
| 935280517132 | 制造商:NXP Semiconductors 功能描述:IC TRANSLATING BUFFER 6XSON |
| 935281751112 | 制造商:NXP Semiconductors 功能描述:IC BUFFER/DVR 16BIT 3ST 48TSSOP |
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