參數(shù)資料
型號： 440GX
廠商： Applied Micro Circuits Corp.
英文描述： Power PC 440GX Embedded Processor
中文描述： 超出了Power PC嵌入式處理器
文件頁數(shù)： 84/93頁
文件大小： 794K
代理商： 440GX
440GX – Power PC 440GX Embedded Processor
AMCC
85
Revision 1.15 – August 30, 2007
Data Sheet
In the following examples, the data strobes (DQS) and the data are shown to be coincident. There is actually a
slight skew as specified by the SDRAM specifications, and there can be additional skew due to loading and signal
routing. It is recommended that the signal length for all of the eight DQS signals be matched.
I/O Timing—DDR SDRAM TSIN and TDIN
Notes:
1. TSIN = Delay from DQS at package pin to C on Stage 1 FF.
2. TDIN = Delay from data at package pin to D on Stage 1 FF.
3. The time values for TSIN include 1/4 of a cycle at the indicated clock speed.
Clock Speed (MHz)
Signal Name
TSIN (ns)
minimum
TSIN (ns)
maximum
Signal Name
TDIN (ns)
minimum
TDIN (ns)
maximum
166
DQS0
2.132
2.884
MemData00:07
0.779
1.502
166
DQS1
2.132
2.867
MemData08:15
0.789
1.521
166
DQS2
2.127
2.873
MemData16:23
0.779
1.530
166
DQS3
2.116
2.851
MemData24:31
0.791
1.553
166
DQS4
2.100
2.845
MemData32:39
0.766
1.501
166
DQS5
2.103
2.844
MemData40:47
0.754
1.525
166
DQS6
2.144
2.902
MemData48:55
0.747
1.513
166
DQS7
2.110
2.864
MemData56:63
0.770
1.521
166
DQS8
2.122
2.860
ECC0:7
0.759
1.464
200
DQS0
1.942
2.365
MemData00:07
0.638
1.165
200
DQS1
1.920
2.314
MemData08:15
0.631
1.149
200
DQS2
1.938
2.361
MemData16:23
0.634
1.151
200
DQS3
1.945
2.370
MemData24:31
0.624
1.169
200
DQS4
1.932
2.332
MemData32:39
0.630
1.151
200
DQS5
1.936
2.348
MemData40:47
0.619
1.133
200
DQS6
1.938
2.356
MemData48:55
0.635
1.149
200
DQS7
1.943
2.360
MemData56:63
0.642
1.151
200
DQS8
1.952
2.381
ECC0:7
0.641
1.141
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