參數(shù)資料
型號(hào)： XR16C872
廠商： Exar Corporation
英文描述： Dual UART with 1284 Parallel Port and Plug-and-Play（PnP） Controller(雙通用異步接收器/發(fā)送器（帶1284雙向并行端口和即插即用控制器）)
中文描述： 雙UART）與1284并行端口，插頭插即用（PnP）功能控制器（雙通用異步接收器/發(fā)送器（帶1284雙向并行端口和即插即用控制器）
文件頁(yè)數(shù)： 30/60頁(yè)
文件大小： 314K
代理商： XR16C872
XR16C872
30
Rev. P1.00
Preliminary
Trigger Table-A (Transmit)
“Default setting after reset, ST16C550 mode”
BIT-5
BIT-4
FIFO Trigger Level
X
X
None
Trigger Table-B (Transmit)
BIT-5
BIT-4
FIFO Trigger Level
0
0
1
1
0
1
0
1
16
8
24
30
Trigger Table
-
-C (Transmit)
BIT-5
BIT-4
FIFO Trigger Level
0
0
1
1
0
1
0
1
8
16
32
56
Trigger Table-D (Transmit)
BIT-5
BIT-4
FIFO trigger level
X
X
User programmable
trigger levels
FCR BIT 6-7: (logic 0 or cleared is the default condition,
RX trigger level =8)
These bits are used to set the trigger level for the
receiver FIFO interrupt. The interrupt will trigger again
when RX data is unloaded below the threshold and
incoming data fills it back up to the trigger level. The
FCTR Bits 4-5 selects one of the following table.
Trigger Table-A (Receive)
“Default setting after reset, ST16C550 mode”
BIT-7
BIT-6
FIFO trigger level
0
0
1
1
0
1
0
1
1
4
8
14
Trigger Table
-
B (Receive)
BIT-7
BIT-6
FIFO trigger level
0
0
1
1
0
1
0
1
8
16
24
28
Trigger Table-C (Receive)
BIT-7
BIT-6
FIFO trigger level
0
0
1
1
0
1
0
1
8
16
56
60
Trigger Table-D (Receive)
BIT-7
BIT-6
FIFO trigger level
X
X
User programmable
trigger levels
相關(guān)PDF資料
PDF描述
XR16L2450 2.25V TO 5.5V DUART
XR16L2450IJ 97-3108A20-29S-KIT
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XR16L2550IL LOW VOLTAGE DUART WITH 16-BYTE FIFO
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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