參數(shù)資料
型號： XC3S1400AN-4FGG484I
廠商： Xilinx Inc
文件頁數(shù)： 121/123頁
文件大?。?/td> 0K
描述： IC FPGA SPARTAN-3AN 484FPGA
標(biāo)準(zhǔn)包裝： 60
系列： Spartan®-3AN
LAB/CLB數(shù)： 2816
邏輯元件/單元數(shù)： 25344
RAM 位總計： 589824
輸入/輸出數(shù)： 372
門數(shù)： 1400000
電源電壓： 1.14 V ~ 1.26 V
安裝類型： 表面貼裝
工作溫度： -40°C ~ 100°C
封裝/外殼： 484-BBGA
供應(yīng)商設(shè)備封裝： 484-FBGA
Spartan-3AN FPGA Family: Pinout Descriptions
DS557 (v4.1) April 1, 2011
Product Specification
97
User I/Os by Bank
Table 77 indicates how the 311 available user-I/O pins are distributed between the four I/O banks on the FGG400 package.
The AWAKE pin is counted as a dual-purpose I/O.
Footprint Migration Differences
The XC3S400AN is the only Spartan-3AN FPGA offered in the FGG400 package.
The XC3S400AN FPGA is pin compatible with the Spartan-3A XC3S400A FPGA in the FG(G)400 package, although the
Spartan-3A FPGA requires an external configuration source.
VCCAUX TMS
E4
JTAG
VCCAUX VCCAUX
A13
VCCAUX
VCCAUX VCCAUX
E16
VCCAUX
VCCAUX VCCAUX
H1
VCCAUX
VCCAUX VCCAUX
K13
VCCAUX
VCCAUX VCCAUX
L8
VCCAUX
VCCAUX VCCAUX
N20
VCCAUX
VCCAUX VCCAUX
T5
VCCAUX
VCCAUX VCCAUX
Y8
VCCAUX
VCCINT
J10
VCCINT
J12
VCCINT
K9
VCCINT
K11
VCCINT
L10
VCCINT
L12
VCCINT
M9
VCCINT
M11
VCCINT
N10
VCCINT
Table 76: Spartan-3AN FGG400 Pinout (Cont’d)
Bank
Pin Name
FGG400
Ball
Type
Table 77: User I/Os Per Bank for the XC3S400AN in the FGG400 Package
Package
Edge
I/O Bank
Maximum I/Os
All Possible I/O Pins by Type
I/O
INPUT
DUAL
VREF
CLK
Top
0
77
50
12
1
6
8
Right
1
79
21
12
30
8
Bottom
2
76
35
6
21
6
8
Left
3
79
49
16
0
6
8
Total
311
155
46
52
26
32
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PDF描述
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參數(shù)描述
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