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參數(shù)資料
| 型號： | V54C316162VAT10 |
| 廠商： | MOSEL-VITELIC |
| 元件分類： | DRAM |
| 英文描述： | 1M X 16 SYNCHRONOUS DRAM, 8 ns, PDSO50 |
| 封裝： | 0.400 INCH, PLASTIC, TSOP2-50 |
| 文件頁數(shù)： | 7/61頁 |
| 文件大?。?/td> | 916K |
| 代理商： | V54C316162VAT10 |
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15
V54C316162VA Rev. 1.0 January 1998
MOSEL VITELIC
V54C316162VA
Timing Diagrams (Cont’d)
16. Random Column Read ( Page within same Bank)
16.1 CAS Latency = 1
16.2 CAS Latency = 2
16.3 CAS Latency = 3
17. Random Column Write ( Page within same Bank)
17.1 CAS Latency = 1
17.2 CAS Latency = 2
17.3 CAS Latency = 3
18. Random Row Read ( Interleaving Banks)
18.1 CAS Latency = 1
18.2 CAS Latency = 2
18.3 CAS Latency = 3
19. Random Row Write ( Interleaving Banks)
19.1 CAS Latency = 1
19.2 CAS Latency = 2
19.3 CAS Latency = 3
20. Full Page Read Cycle
20.1 CAS Latency = 1
20.2 CAS Latency = 2
20.3 CAS Latency = 3
21. Full Page Write Cycle
21.1 CAS Latency = 1
21.2 CAS Latency = 2
21.3 CAS Latency = 3
22. Precharge Termination of a Burst
22.1 CAS Latency = 1
22.2 CAS Latency = 2
22.3 CAS Latency = 3
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PDF描述 |
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參數(shù)描述 |
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