參數(shù)資料
型號(hào)： V54C316162VAT10
廠商： MOSEL-VITELIC
元件分類： DRAM
英文描述： 1M X 16 SYNCHRONOUS DRAM, 8 ns, PDSO50
封裝： 0.400 INCH, PLASTIC, TSOP2-50
文件頁(yè)數(shù)： 4/61頁(yè)
文件大?。?/td> 916K
代理商： V54C316162VAT10
12
V54C316162VA Rev. 1.0 January 1998
MOSEL VITELIC
V54C316162VA
Clock Frequency and Latency
#
Symbol
Parameter
-8
-10
-12
Unit
1
tCK
Clock Frequency
max.
125
83
100
66
83
66
MHz
2
tAA
CAS Latency
min.
3
2
3
2
3
CLK
3
tCK
Clock Cycle Time
min.
8
12
10
15
12
15
ns
4
tRCD
Row to Column Delay
min.
3
2
3
2
3
2
CLK
5
tRL
RAS Latency
min.
6
4
6
4
6
5
CLK
6
tRAS
Row Active Time
min.
5
3
5
3
5
4
CLK
7
max.
120
s
8
tRP
Row Precharge Time
min.
3
2
3
2
3
CLK
9
tRC
Row Cycle time
min.
8
5
8
5
8
7
CLK
10
tDPL
Last Data-In to Precharge (Write Recovery)
min.
2
1
2
1
2
CLK
11
tDPL +
tRP
Last Data-In to Active / Refresh
min.
5
3
5
3
5
CLK
12
tRRD
Bank to Bank Delay Time
min.
2
CLK
13
tCCD
CAS to CAS delay time
min.
1
CLK
14
tWL
Write Latency
fixed
0
CLK
15
tDQW
DQM Write Mask Latency
fixed
0
CLK
16
tDQZ
DQM Data Disable Latency
fixed
2
CLK
17
tCSL
Clock Suspend Latency
fixed
1
CLK
相關(guān)PDF資料
PDF描述
V54C3256164VAT6 16M X 16 SYNCHRONOUS DRAM, 5.4 ns, PDSO54
V54C3256404VDS8IPC 64M X 4 SYNCHRONOUS DRAM, 6 ns, PBGA60
V54C3256404VDUG7 64M X 4 SYNCHRONOUS DRAM, 5.4 ns, PBGA54
V54C3256404VDLJ6 64M X 4 SYNCHRONOUS DRAM, 5.4 ns, PBGA60
V54C3256404VDUI6 64M X 4 SYNCHRONOUS DRAM, 5.4 ns, PDSO54
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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V54C316162VC-55 制造商:MOSEL 制造商全稱:MOSEL 功能描述:200/183/166/143 MHz 3.3 VOLT, 2K REFRESH ULTRA HIGH PERFORMANCE 1M X 16 SDRAM 2 BANKS X 512Kbit X 16
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