參數(shù)資料
型號(hào)： TMP320C40
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： DIGITAL SIGNAL PROCESSORS
中文描述： 數(shù)字信號(hào)處理器
文件頁(yè)數(shù)： 55/62頁(yè)
文件大?。?/td> 1066K
代理商： TMP320C40
SGUS017H
–
OCTOBER 1993
–
REVISED OCTOBER 2001
55
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251
–
1443
timing parameters for timer pin (see Note 13 and Figure 27)
NO.
’
320C40-40
’
320C40-50
’
320C40-60
UNIT
MIN
MAX
1
tsu(TCLK-H1L)
th(H1L-TCLK)
td(H1H-TCLK)
Setup time, TCLK before H1 low
10
ns
2
Hold time, TCLK after H1 low
0
ns
3
Delay time, TCLK valid after H1 high
13
ns
NOTE 13: Period and polarity of valid logic level are specified by contents of internal control registers.
3
3
Peripheral Pin
(TCLK)
H1
H3
1
2
Figure 27. Timer Pin Timing Cycle
timing for IEEE 1149.1 test-access port (see Figure 28)
NO.
’
320C40-40
’
320C40-50
’
320C40-60
UNIT
MIN
MAX
1
tsu(TMS-TCKH)
th(TCKH-TMS)
td(TCKL-TDOV)
Setup time, TMS/TDI before TCK high
10
ns
2
Hold time, TMS/TDI after TCK high
5
ns
3
Delay time, TCK low to TDO valid
0
15
ns
TCK
TMS/TDI
TDO
3
2
1
Figure 28. JTAG Emulation Timings
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PDF描述
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參數(shù)描述
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