參數(shù)資料
型號(hào)： TDAT042G51A-3BLL1
英文描述： TDAT SONET/SDH 155/622/2488 Mbits/s Data Interfaces
中文描述： TDAT的SONET / SDH 155/622/2488 Mbits /秒數(shù)據(jù)接口
文件頁(yè)數(shù)： 202/310頁(yè)
文件大小： 4628K
代理商： TDAT042G51A-3BLL1
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174
Agere Systems Inc.
Data Sheet
May 2001
155/622/2488 Mbits/s Data Interface
TDAT042G5 SONET/SDH
Register Descriptions
(continued)
OHP Registers
(continued)
Table 79. Registers 0x0422
—
0x042D: Receive Control (R/W)
(continued)
Reset default of registers = 0x0000.
Address
(Hex)
0422, 0424,
0426, 0428
Bit #
Name
Function
Reset
Default
0
9
LOS_AISINH[A
—
D]
Loss-of-Signal AIS Inhibit.
When set to logic
1, the line AIS insertion will be inhibited in case
of loss-of-signal.
Signal Fail B1/B2 Error Count Select.
When
set to logic 0, the B1 errors will be used by the
signal fail error rate algorithm; otherwise, B2
errors are used.
Signal Degrade B1/B2 Error Count Select.
When set to logic 0, the B1 errors will be used
by the signal degrade error rate algorithm; oth-
erwise, B2 errors are used.
Reset CNTD Counters on B1 Error.
Active-
high control bits to reset continuous N time
detect counters upon received B1 errors. Only
CNTDB1SEL[0] is valid for STS-48/STM-16.
8
SFB1B2SEL[A
—
D]
0
7
SDB1B2SEL[A
—
D]
0
6
CNTDB1SEL[A
—
D]
0
5
S1MON8_OR_4CTL[A
—
D]
S1 Byte or Nibble.
When set to logic 1, the S1
byte will be monitored as two nibbles. Other-
wise, it is treated as a byte. Only
S1MON8or4CTL[A] is valid for STS-48/STM-
16.
K1K2_2_OR_1[A
—
D]
K1 and K2 Treated as 2 Registers or 1.
When
a bit is set to 1, the K1 and K2 bytes will be
treated as one 16-bit register. Otherwise, they
will be treated as two registers of size 13
(K1[7:0] and K2[7:3]) and 3 (K2[2:0]).
K1K2_2_OR_1[A] is valid for STS-48/STM-16.
B2BITBLKCNT[A
—
D]
B2 Error Count in Bit or Block.
When set to 0,
B2 check logic will count bit errors; otherwise, it
counts block errors. Only B2BITBLKCNT[A] is
valid for STS-48/STM-16.
DSCRINH[A
—
D]
Descramble Inhibit Control.
When a bit is set
to 1, the descrambler for that is disabled. In
STS-48/STM-16 mode, all 4 bits need to be set
to same value.
B1BITBLKCNT[A
—
D]
B1 Error Count in Bit or Block.
When set to 0,
B1 check logic will count bit errors; otherwise, it
counts block errors. Only B1BITBLKCNT[A] is
valid for STS-48/STM-16.
ROH_BYPASS[A
—
D]
Receive Overhead Bypass.
Control bit, when
set to 1, causes the received data to pass
through the block retimed. In STS-48/STM-16
mode, all 4 bits need to be set to same value.
0
4
0
3
0
2
0
1
0
0
0
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