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參數(shù)資料
| 型號： | TDAT042G51A-3BLL1 |
| 英文描述： | TDAT SONET/SDH 155/622/2488 Mbits/s Data Interfaces |
| 中文描述： | TDAT的SONET / SDH 155/622/2488 Mbits /秒數(shù)據(jù)接口 |
| 文件頁數(shù)： | 186/310頁 |
| 文件大?。?/td> | 4628K |
| 代理商： | TDAT042G51A-3BLL1 |
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158
Agere Systems Inc.
Data Sheet
May 2001
155/622/2488 Mbits/s Data Interface
TDAT042G5 SONET/SDH
Register Descriptions
(continued)
UT Registers
(continued)
UT Provisioning Registers (R/W)
(continued)
Table 61. Registers 0x020F, 0x0213, 0x0217, 0x021B: Channel [A
—
D] Receive Provisioning Register (R/W)
Reset default of register 0x020F = 0x0020.
Reset default of register 0x0213 = 0x0120.
Reset default of register 0x0217 = 0x0220.
Reset default of register 0x021B = 0x0320.
Address
(Hex)
020F, 0213,
0217, 021B
Bit #
Name
Function
Reset
Default
0
15
POLLING_ENB_Rx
[A
—
D]
—
Polling Enable Receive Channel [A
—
D].
If
set to 1, receive polling mode is enabled.
Reserved.
These bits must be written to their
reset default value (00).
Polling Receive Address Channel [A
—
D].
Receive polling address.
14
—
13
00
12
—
8
RxADDR_A[4:0]
RxADDR_B[4:0]
RxADDR_C[4:0]
RxADDR_D[4:0]
—
00000
00001
00010
00011
0
7
Reserved.
This bit must be written to its reset
default value (0).
Clock Mode Receive Channel [A
—
D].
Defines if the RxCLK[A
—
D] is sourced or sunk.
If this bit = 1, the clock is sourced, and then
(1) the corresponding Tx clock is used as
RxCLK[A
—
D], and (2) this clock is also sent out
of the device via RxCLK[A
—
D].
If this bit = 0, CLOCK_MODE_Rx[A
—
D] is
sunk, and then RxCLK[A
—
D] acts as an input.
Default is sink.
Parity Receive Channel [A
—
D].
Defines if odd
(bit = 1) or even (bit = 0) parity is generated for
the data transmitted across the UTOPIA PHY
Rx interface. Default is odd.
ATM Packet Size Receive Channel [A
—
D].
Defines how many bytes are received per ATM
cell. Default is 53 bytes. Valid only when traffic
type is ATM cells.
6
CLOCK_MODE_Rx
[A
—
D]
0
5
PARITY_Rx[A
—
D]
1
4
ATM_SIZE_Rx[A
—
D]
Page 86 and page 87 give details of the func-
tion of this bit.
0 = standard 53-byte (also 54-byte and 56-byte)
ATM cell modes.
1 = 52-byte ATM cell mode (HEC omitted).
Traffic Type Receive Channel [A
—
D].
Config-
ures channel to receive either ATM cells or
packets.
Bit Value
Traffic Type
0
packets (default)
1
ATM cells
0
3
TRAFFIC_TYPE_Rx
[A
—
D]
0
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