參數(shù)資料
型號： SC1201UCL-266
廠商： ADVANCED MICRO DEVICES INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 266 MHz, MICROPROCESSOR, PBGA432
封裝： 40 X 40 MM, 1.72 MM HEIGHT, 1.27 MM PITCH, MO-151, EBGA-432
文件頁數(shù)： 442/465頁
文件大?。?/td> 4068K
代理商： SC1201UCL-266
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78
AMD Geode SC1200/SC1201 Processor Data Book
Signal Definitions
Revision 7.1
3.4.10
IDE Interface Signals
Signal Name
Ball No.
Type
Description
Mux
EBGA
TEPBGA
IDE_RST#
A22
AA1
O
IDE Reset. This signal resets all devices
attached to the IDE interface.
TFTDCK
IDE_ADDR2
C17
U2
O
IDE Address Bits. These address bits are
used to access a register or data port in a
device on the IDE bus.
TFTD4
IDE_ADDR1
C26
AE1
TFTD2
IDE_ADDR0
A26
AD3
TFTD3
IDE_DATA[15:0]
See
See
I/O
IDE Data Lines. IDE_DATA[15:0] transfers
data to/from the IDE devices.
The IDE interface is
muxed with the TFT
interface. See Table
muxing details.
IDE_IOR0#
C21
Y4
O
IDE I/O Read Channels 0 and 1.
IDE_IOR0# is the read signal for Channel 0
and IDE_IOR1# is the read signal for Chan-
nel 1. Each signal is asserted at read
accesses to the corresponding IDE port
addresses.
TFTD10
IDE_IOR1#
AH3
D28
O
GPIO6+DTR2#/
BOUT2+SDTEST5#
IDE_IOW0#
D24
AD2
O
IDE I/O Write Channels 0 and 1.
IDE_IOW0# is the write signal for Channel 0.
IDE_IOW1# is the write signal for Channel 1.
Each signal is asserted at write accesses to
corresponding IDE port addresses.
TFTD9
IDE_IOW1#
AG4
C28
O
GPIO9+DCD2#+
SDTEST2
IDE_CS0#
A27
AF2
O
IDE Chip Selects 0 and 1. These signals are
used to select the command block registers
in an IDE device.
TFTD5
IDE_CS1#
C16
P2
O
TFTDE
IDE_IORDY0
A25
AD1
I
I/O Ready Channels 0 and 1. When de-
asserted, these signals extend the transfer
cycle of any host register access if the
required device is not ready to respond to the
data transfer request.
Note:
If
selected
as
IDE_IORDY0
or
IDE_IORDY1
function(s)
but
not
used, then signal(s) should be tied
high.
TFTD11
IDE_IORDY1
AJ1
B29
I
GPIO10+DSR2#+
SDTEST1
IDE_DREQ0
C24
AC4
I
DMA Request Channels 0 and 1. The
IDE_DREQ signals are used to request a
DMA transfer from the SC1200/SC1201 pro-
cessor. The direction of transfer is deter-
mined by the IDE_IOR/IOW signals.
Note:
If
selected
as
IDE_DREQ0/
IDE_DREQ1 function but not used,
tie IDE_DREQ0/IDE_DREQ1 low.
TFTD8
IDE_DREQ1
AJ2
C31
I
GPIO8+CTS2#
+SDTEST5
IDE_DACK0#
C25
AD4
O
DMA Acknowledge Channels 0 and 1. The
IDE_DACK# signals acknowledge the DREQ
request to initiate DMA transfers.
TFTD0
IDE_DACK1#
AH4
C30
O
GPIO7+RTS2#
+SDTEST0
相關(guān)PDF資料
PDF描述
SC1201UCL-266F 32-BIT, 266 MHz, MICROPROCESSOR, PBGA432
SC12484CV-80 PALETTE-DAC DSPL CTLR, PQCC44
SC11483CV-110 PALETTE-DAC DSPL CTLR, PQCC44
SC11483CV-80 PALETTE-DAC DSPL CTLR, PQCC44
SC12482CV-80 PALETTE-DAC DSPL CTLR, PQCC44
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
SC1201UCL-266 D3 制造商:Advanced Micro Devices 功能描述:
SC1201UFH-266 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Advanced Micro Devices 功能描述: 制造商:AMD 功能描述:
SC1201UFH-266B 制造商:Rochester Electronics LLC 功能描述:- Bulk
SC1201UFH-266F 制造商:Rochester Electronics LLC 功能描述:- Bulk
SC1201UFH-266FR 制造商:Rochester Electronics LLC 功能描述:- Bulk
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