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參數(shù)資料
| 型號： | SC1201UCL-266 |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA432 |
| 封裝： | 40 X 40 MM, 1.72 MM HEIGHT, 1.27 MM PITCH, MO-151, EBGA-432 |
| 文件頁數(shù)： | 405/465頁 |
| 文件大?。?/td> | 4068K |
| 代理商： | SC1201UCL-266 |
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AMD Geode SC1200/SC1201 Processor Data Book
463
Appendix A: Data Book Revision History
Revision 7.1
Table A-2. Edits to Current Revision
Section
Revision
Section 1.0
“AMD Geode
SC1200/SC1201
Processor”
— Other Features: Modified Voltages sub-bullets for clarification purposes.
Section 2.0
“Architecture
Overview”
No changes.
Section 3.0
“Signal
Definitions”
— Rewrote SERR# description, was wrong.
— Changed footnote to say “A 15 K
pull-down resistor is required on all ports (even if unused).”
Section 4.0
“General
Configuration
Block”
— Added note: “Note: Not all speeds are supported. For information on supported speeds, see
Section 5.0
“SuperI/O
Module”
No changes.
Section 6.0
“Core Logic
Module”
— Added text in parenthesis to first bullet. Now reads as “Standard seven-channel DMA support
(Channels 5 through 7 are not supported).”
— DMA Channels subsection: Added last sentence to last paragraph “DMA Channels 5 through 7
are not supported.”
— Added second sentence to first paragraph, “The PIC devices support all x86 modes of opera-
tion except Special Fully Nested mode.”
— F0 Index 6Ch (ROM Mask Register): Corrected reset value to 0000FFF0h (was listed as
FFF0h). Added note, “Note: Register must be read/written as a DWORD.” Also corrected reset
value and “Width” column in Table 6-14 on page 196 (register summary table).
— F0BAR1+I/O Offset 00h: Rewrote bit descriptions and added note for clarification purposes.
— F0BAR1+Offset 0Ch: Rewrote bit descriptions and added note for clarification purposes.
— F0BAR1+Offset 10h[13]: Changed note. Did say “This bit should not be enabled when using
the internal SuperI/O module and if IO_SIOCFG_IN (F5BAR0+I/O Offset 00h[26:25]) = 11.”
Now says “This bit should not be routed to LPC when using the internal SuperI/O module and if
IO_SIOCFG_IN (F5BAR0+I/O Offset 00h[26:25]) = 10.”
— F1BAR0+I/O Offset 00h[11] and Offset 02h[11]: Clarified that the IRQ2 is from the SIO module
and not an external SIO.
— F2 Index 40h and 44h: Removed Format 0 and Format 1 settings for a Fast-PCI clock
frequency of 48 MHz since it is not supported.
— Changed register descriptions in Table 6-43 and Table 6-44 to emphasize that DMA Channels 5
through 7 are not supported.
Section 7.0
“Video
Processor
Module”
No changes.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SC1201UCL-266F | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA432 |
| SC12484CV-80 | PALETTE-DAC DSPL CTLR, PQCC44 |
| SC11483CV-110 | PALETTE-DAC DSPL CTLR, PQCC44 |
| SC11483CV-80 | PALETTE-DAC DSPL CTLR, PQCC44 |
| SC12482CV-80 | PALETTE-DAC DSPL CTLR, PQCC44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SC1201UCL-266 D3 | 制造商:Advanced Micro Devices 功能描述: |
| SC1201UFH-266 | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Advanced Micro Devices 功能描述: 制造商:AMD 功能描述: |
| SC1201UFH-266B | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| SC1201UFH-266F | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| SC1201UFH-266FR | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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