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參數(shù)資料
| 型號： | SC1201UCL-266 |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA432 |
| 封裝： | 40 X 40 MM, 1.72 MM HEIGHT, 1.27 MM PITCH, MO-151, EBGA-432 |
| 文件頁數(shù)： | 358/465頁 |
| 文件大?。?/td> | 4068K |
| 代理商： | SC1201UCL-266 |
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420
AMD Geode SC1200/SC1201 Processor Data Book
Electrical Specifications
Revision 7.1
Table 9-27. IDE Register Transfer to/from Device Timing Parameters
Symbol
Parameter
Mode
Unit
Comments
01235
t0
Cycle time (min)
600
383
240
180
120
ns
Note 1
t1
Address valid to IDE_IOR[0:1]#/
IDE_IOW[0:1]# setup (min)
70
50
30
25
ns
t2
IDE_IOR[0:1]#/IDE_IOW[0:1]# pulse
width 8-bit (min)
290
80
70
ns
t2i
IDE_IOR[0:1]#/IDE_IOW[0:1]#
recovery time (min)
-
70
25
ns
t3
IDE_IOW[0:1]# data setup (min)
6045303020
ns
t4
IDE_IOW[0:1]# data hold (min)
30
20
15
10
ns
t5
IDE_IOR[0:1]# data setup (min)
5035202020
ns
t6
IDE_IOR[0:1]# data hold (min)
55555
ns
t6Z
IDE_IOR[0:1]# data TRI-STATE
(max)
30
ns
Note 2
t9
IDE_IOR[0:1]#/IDE_IOW[0:1]# to
address valid hold (min)
20
15
10
ns
tRD
Read data valid to IDE_IORDY[0:1]
active (if IDE_IORDY[0:1] initially low
after tA (min)
00000
ns
tA
IDE_IORDY[0:1] setup time
35
ns
Note 3
tB
IDE_IORDY[0:1] pulse width (max)
1250
ns
tC
IDE_IORDY[0:1] assertion to release
(max)
55555
ns
Note 1. t0 is the minimum total cycle time, t2 is the minimum command active time, and t2i is the minimum command recov-
ery time or command inactive time. The actual cycle time equals the sum of the command active time and the com-
mand inactive time. The three timing requirements of t0, t2, and t2i are met. The minimum total cycle time
requirements is greater than the sum of t2 and t2i. (This means that a host implementation can lengthen t2 and/or
t2i to ensure that t0 is equal to or greater than the value reported in the device’s IDENTIFY DEVICE data.)
Note 2. This parameter specifies the time from the rising edge of IDE_IOR[0:1]# to the time that the data bus is no longer
driven by the device (TRI-STATE).
Note 3. The delay from the activation of IDE_IOR[0:1]# or IDE_IOW[0:1]# until the state of IDE_IORDY[0,1] is first sampled.
If IDE_IORDY[0:1] is inactive, then the host waits until IDE_IORDY[0:1] is active before the PIO cycle is completed.
If the device is not driving IDE_IORDY[0:1] negated after activation (tA) of IDE_IOR[0:1]# or IDE_IOW[0:1]#, then
t5 is met and tRD is not applicable. If the device is driving IDE_IORDY[0:1] negated after activation (tA) of
IDE_IOR[0:1]# or IDE_IOW[0:1]#, then tRD is met and t5 is not applicable.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SC1201UCL-266F | 32-BIT, 266 MHz, MICROPROCESSOR, PBGA432 |
| SC12484CV-80 | PALETTE-DAC DSPL CTLR, PQCC44 |
| SC11483CV-110 | PALETTE-DAC DSPL CTLR, PQCC44 |
| SC11483CV-80 | PALETTE-DAC DSPL CTLR, PQCC44 |
| SC12482CV-80 | PALETTE-DAC DSPL CTLR, PQCC44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SC1201UCL-266 D3 | 制造商:Advanced Micro Devices 功能描述: |
| SC1201UFH-266 | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Advanced Micro Devices 功能描述: 制造商:AMD 功能描述: |
| SC1201UFH-266B | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| SC1201UFH-266F | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
| SC1201UFH-266FR | 制造商:Rochester Electronics LLC 功能描述:- Bulk |
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