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參數(shù)資料
| 型號(hào)： | S1C63406D0A0100 |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, UUC103 |
| 封裝： | DIE-103 |
| 文件頁(yè)數(shù)： | 40/151頁(yè) |
| 文件大?。?/td> | 1171K |
| 代理商： | S1C63406D0A0100 |
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126
EPSON
S1C63406/408 TECHNICAL MANUAL
CHAPTER 7: ELECTRICAL CHARACTERISTICS
7.6 Serial Interface AC Characteristics
Clock synchronous master mode
During 32 kHz operation
Item
Transmitting data output delay time
Receiving data input set-up time
Receiving data input hold time
Symbol
tsmd
tsms
tsmh
Unit
s
Max.
5
Typ.
Min.
10
5
Condition: VDD=3.0V, VSS=0V, Ta=-40 to 85
°C, VIH1=0.8VDD, VIL1=0.2VDD, VOH=0.8VDD, VOL=0.2VDD
During 1 MHz operation
Item
Transmitting data output delay time
Receiving data input set-up time
Receiving data input hold time
Symbol
tsmd
tsms
tsmh
Unit
ns
Max.
200
Typ.
Min.
400
200
Note that the maximum clock frequency is limited to 2 MHz.
Condition: VDD=3.0V, VSS=0V, Ta=-40 to 85
°C, VIH1=0.8VDD, VIL1=0.2VDD, VOH=0.8VDD, VOL=0.2VDD
Clock synchronous slave mode
During 32 kHz operation
Item
Transmitting data output delay time
Receiving data input set-up time
Receiving data input hold time
Symbol
tssd
tsss
tssh
Unit
s
Max.
10
Typ.
Min.
10
5
Condition: VDD=3.0V, VSS=0V, Ta=-40 to 85
°C, VIH1=0.8VDD, VIL1=0.2VDD, VOH=0.8VDD, VOL=0.2VDD
During 1 MHz operation
Item
Transmitting data output delay time
Receiving data input set-up time
Receiving data input hold time
Symbol
tssd
tsss
tssh
Unit
ns
Max.
500
Typ.
Min.
400
200
Note that the maximum clock frequency is limited to 2 MHz.
Condition: VDD=3.0V, VSS=0V, Ta=-40 to 85
°C, VIH1=0.8VDD, VIL1=0.2VDD, VOH=0.8VDD, VOL=0.2VDD
<Master mode>
SCLK OUT
SOUT
SIN
VOH
VOL
tsms
tsmh
tsmd
VIH1
VIL1
VOL
<Slave mode>
SCLK IN
SOUT
SIN
VIH1
VOH
VOL
tsss
tssh
tssd
VIH1
VIL1
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