參數(shù)資料
型號(hào)： ORT8850
英文描述： Field-Programmable System Chip (FPSC) Eight-Channel x 850 Mbits/s Backplane Transceiver
中文描述： 現(xiàn)場(chǎng)可編程系統(tǒng)芯片（促進(jìn)文化基金）8通道x 850 Mbits /秒背板收發(fā)器
文件頁數(shù)： 89/112頁
文件大?。?/td> 2417K
代理商： ORT8850
Agere Systems Inc.
89
Data Sheet
August 2001
Eight-Channel x 850 Mbits/s Backplane Transceiver
ORCA
ORT8850 FPSC
Pin Information
(continued)
Table 34. ORT8850L and ORT8850H 680-Pin PBGAM Pinout
(continued)
BM680
V
DD
IO
Bank
7 (CL)
—
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
—
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
—
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
—
7 (CL)
7 (CL)
—
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
7 (CL)
—
7 (CL)
VREF
Group
1
—
2
2
2
2
—
2
2
3
3
—
3
3
3
3
3
3
4
4
—
4
4
4
4
—
4
4
—
5
5
—
5
5
5
5
5
5
6
6
—
6
I/O
ORT8850L
ORT8850H
Additional Function
Pair
N5
IO
V
SS
IO
IO
IO
IO
V
DD
IO7
IO
IO
IO
IO
V
SS
IO
IO
IO
IO
IO
IO
IO
IO
V
SS
IO
IO
IO
IO
V
DD
IO7
IO
IO
V
SS
IO
IO
V
SS
IO
IO
IO
IO
IO
IO
IO
IO
V
SS
IO
PL9C
V
SS
PL9B
PL9A
PL10D
PL10C
V
DD
IO7
PL10B
PL10A
PL11D
PL11C
V
SS
PL11B
PL11A
PL12D
PL12C
PL12B
PL12A
PL13D
PL13C
V
SS
PL13B
PL13A
PL14D
PL14C
V
DD
IO7
PL14B
PL14A
V
SS
PL15D
PL15C
V
SS
PL15B
PL15A
PL16D
PL16C
PL16B
PL16A
PL17D
PL17C
V
SS
PL17B
PL16C
V
SS
PL17D
PL17C
PL18D
PL18C
V
DD
IO7
PL19D
PL19C
PL20D
PL20C
V
SS
PL21D
PL21C
PL22D
PL22C
PL22B
PL22A
PL23D
PL23C
V
SS
PL23B
PL23A
PL24D
PL24C
V
DD
IO7
PL24B
PL24A
V
SS
PL25D
PL25C
V
SS
PL25B
PL25A
PL26D
PL26C
PL27D
PL27C
PL28D
PL28C
V
SS
PL29D
D4
—
—
—
L3T_D3
—
L4C_D1
L4T_D1
L5C_D2
L5T_D2
—
L6C_D2
L6T_D2
L7C_D0
L7T_D0
—
L8C_D2
L8T_D2
L9C_A0
L9T_A0
L10C_D1
L10T_D1
L11C_D3
L11T_D3
—
L12C_D1
L12T_D1
L13C_A0
L13T_A0
—
L14C_A0
L14T_A0
—
L15C_A0
L15T_A0
—
L16C_A0
L16T_A0
L17C_A2
L17T_A2
L18C_D1
L18T_D1
L19C_D0
L19T_D0
—
L20C_D3
AM22
L2
N4
P5
M2
M3
M1
P4
N2
P3
AM32
R4
N1
P2
P1
T4
R2
U5
R1
AN1
V5
T3
T2
T1
R3
U4
U3
AN2
U2
V2
AN33
V3
V4
W5
W2
W3
Y1
Y2
AA1
AN34
Y5
RDY/BUSY_N/RCLK
VREF_7_02
—
A13/PPC_A27
A12/PPC_A26
—
—
—
A11/PPC_A25
VREF_7_03
—
—
—
—
RD_N/MPI_STRB_N
VREF_7_04
—
—
—
PLCK0C
PLCK0T
—
—
—
—
A10/PPC_A24
A9/PPC_A23
—
—
—
A8/PPC_A22
VREF_7_05
—
—
PLCK1C
PLCK1T
—
VREF_7_06
相關(guān)PDF資料
PDF描述
ORT8850H Field-Programmable System Chip (FPSC) Eight-Channel x 850 Mbits/s Backplane Transceiver
ORT8850L Field-Programmable System Chip (FPSC) Eight-Channel x 850 Mbits/s Backplane Transceiver
OS1001 Interface IC
OS1010 Optoelectronic
OS1011 SINGLE 1.8V, 200 KHZ OP, E TEMP, -40C to +125C, 8-PDIP, TUBE
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
ORT8850-FPSC-EV 功能描述:可編程邏輯 IC 開發(fā)工具 ORCA ORT8850 FPSC Eval Brd RoHS:否 制造商:Altera Corporation 產(chǎn)品:Development Kits 類型:FPGA 工具用于評(píng)估:5CEFA7F3 接口類型: 工作電源電壓:
ORT8850H 制造商:AGERE 制造商全稱:AGERE 功能描述:Field-Programmable System Chip (FPSC) Eight-Channel x 850 Mbits/s Backplane Transceiver
ORT8850H-1BM680C 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 16192 LUT 297 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
ORT8850H-1BM680I 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 16192 LUT 297 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
ORT8850H-1BMN680C 功能描述:FPGA - 現(xiàn)場(chǎng)可編程門陣列 16192 LUT 297 I/O RoHS:否 制造商:Altera Corporation 系列:Cyclone V E 柵極數(shù)量: 邏輯塊數(shù)量:943 內(nèi)嵌式塊RAM - EBR:1956 kbit 輸入/輸出端數(shù)量:128 最大工作頻率:800 MHz 工作電源電壓:1.1 V 最大工作溫度:+ 70 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-256
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