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參數(shù)資料
| 型號： | MSC8144EC |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Quad Core Digital Signal Processor |
| 中文描述： | 四核心數(shù)字信號處理器 |
| 文件頁數(shù)： | 54/80頁 |
| 文件大?。?/td> | 1145K |
| 代理商： | MSC8144EC |
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MSC8144EC Quad Core Digital Signal Processor Data Sheet, Rev. 6
Freescale Semiconductor
54
2.7.10.2
MII Transmit AC Timing Specifications
Table 46
provides the MII transmit AC timing specifications.
Figure 26
shows the MII transmit AC timing diagram.
2.7.10.3
MII Receive AC Timing Specifications
Table 47
provides the MII receive AC timing specifications.
Figure 25. MII Management Interface Timing
Table 46. MII Transmit AC Timing Specifications
Parameter/Condition
Symbol
1
Min
Max
Unit
TX_CLK duty cycle
t
MTXH/
t
MTX
35
65
%
TX_CLK to MII data TXD[3:0], TX_ER, TX_EN delay
t
MTKHDX
0
25
ns
TX_CLK data clock rise
t
MTXR
1.0
4.0
ns
TX_CLK data clock fall
t
MTXF
1.0
4.0
ns
Notes:
1.
2.
Typical TX_CLK period (t
MTX
) for 10 Mbps is 400 ns and for 100 Mbps is 40 ns.
Program GCR4 as 0x00030CC3.
Figure 26. MII Transmit AC Timing
Table 47. MII Receive AC Timing Specifications
Parameter/Condition
Symbol
1
Min
Max
Unit
RX_CLK duty cycle
t
MRXH
/t
MRX
35
65
%
ETHMDC
ETHMDIO
(Input)
ETHMDIO
(Output)
t
MDC
t
MDCR
t
MDCH
t
MDDXKH
t
MDDVKH
t
MDKHDX
t
MDHF
TX_CLK
TXD[3:0]
TX_EN
TX_ER
t
MTKHDX
t
MTX
t
MTXH
t
MTXR
t
MTXF
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