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參數(shù)資料
| 型號(hào)： | MQ80C52CXXX-36SCD |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 36 MHz, MICROCONTROLLER, CQFP44 |
| 文件頁數(shù)： | 148/182頁 |
| 文件大?。?/td> | 2994K |
| 代理商： | MQ80C52CXXX-36SCD |
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68
1477K–AVR–08/10
ATtiny26(L)
Figure 39. Timer/Counter1 Synchronization Register Block Diagram
Timer/Counter1 and the prescaler allow running the CPU from any clock source while the pres-
caler is operating on the fast 64 MHz PCK clock in the asynchronous mode.
Note that the system clock frequency must be lower than one half of the PCK frequency. Only
when the system clock is generated from PCK dividing that by two, the ratio of the PCK/system
clock can be exactly two. The synchronization mechanism of the asynchronous Timer/Counter1
needs at least two edges of the PCK when the system clock is high. If the frequency of the sys-
tem clock is too high, it is a risk that data or control values are lost.
The following Figure 40 shows the block diagram for Timer/Counter1.
OCR1A
8-BIT DATABUS
SYNC
MODE
1CK delay
TCNT1
CK
OCF1A
OCF1B
TCNT1
TOV1
OCR1B
OCR1C
TCCR1A
TCCR1B
OCR1A_SI
OCR1B_SI
OCR1C_SI
TCCR1A_SI
TCCR1B_SI
TCNT1
OCF1A
OCF1B
TOV1
TCNT1_SI
OCF1A_SI
OCF1B_SI
TOV1_SI
TCNT_SO
OCF1A_SO
OCF1B_SO
TOV1_SO
S
A
ASYNC
MODE
1PCK delay
1/2PCK -1CK delay
PCK
PCKE
S
A
S
A
S
A
S
A
S
A
no delay
IO-registers
Input syncronization
registers
Timer/Counter1
Output
multiplexers
Output
syncronization
registers
相關(guān)PDF資料 |
PDF描述 |
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