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參數(shù)資料
| 型號： | MPC8544VTARJ |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, 533 MHz, MICROPROCESSOR, PBGA783 |
| 封裝： | 29 X 29 MM, 1 MM PITCH, LEAD FREE, PLASTIC, FC-PBGA-783 |
| 文件頁數(shù)： | 39/112頁 |
| 文件大?。?/td> | 1294K |
| 代理商： | MPC8544VTARJ |
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MPC8544E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 0
32
Freescale Semiconductor
Enhanced Three-Speed Ethernet (eTSEC), MII Management
Figure 11 shows the GMII transmit AC timing diagram.
Figure 11. GMII Transmit AC Timing Diagram
8.3.2.2
GMII Receive AC Timing Specifications
Table 30 provides the GMII receive AC timing specifications.
GTX_CLK data clock fall time (80%-20%)
tGTXF
——
1.0
ns
Notes:
1. The symbols used for timing specifications follow the pattern t(first two letters of functional block)(signal)(state)(reference)(state) for inputs
and t(first two letters of functional block)(reference)(state)(signal)(state) for outputs. For example, tGTKHDV symbolizes GMII transmit
timing (GT) with respect to the tGTX clock reference (K) going to the high state (H) relative to the time date input signals (D)
reaching the valid state (V) to state or setup time. Also, tGTKHDX symbolizes GMII transmit timing (GT) with respect to the
tGTX clock reference (K) going to the high state (H) relative to the time date input signals (D) going invalid (X) or hold time.
Note that, in general, the clock reference symbol representation is based on three letters representing the clock of a particular
functional. For example, the subscript of tGTX represents the GMII(G) transmit (TX) clock. For rise and fall times, the latter
convention is used with the appropriate letter: R (rise) or F (fall).
2. Data valid tGTKHDV to GTX_CLK Min setup time is a function of clock period and max hold time (Min setup = cycle time –
Max delay).
Table 30. GMII Receive AC Timing Specifications
Parameter/Condition
Symbol1
Min
Typ
Max
Unit
Notes
RX_CLK clock period
tGRX
—8.0
—
ns
RX_CLK duty cycle
tGRXH/tGRX
40
—
60
%
RXD[7:0], RX_DV, RX_ER setup time to RX_CLK
tGRDVKH
2.0
—
ns
RX_CLK to RXD[7:0], RX_DV, RX_ER hold time
tGRDXKH
0.5
—
ns
RX_CLK clock rise (20%–80%)
tGRXR
——
1.0
ns
Table 29. GMII Transmit AC Timing Specifications (continued)
Parameter/Condition
Symbol1
Min
Typ
Max
Unit
Notes
GTX_CLK
TXD[7:0]
tGTKHDX
tGTX
tGTXH
tGTXR
tGTXF
tGTKHDV
TX_EN
TX_ER
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