參數(shù)資料
型號： MPC562MZP66R2
廠商： Freescale Semiconductor
文件頁數(shù)： 442/1420頁
文件大?。?/td> 0K
描述： IC MPU 32BIT 66MHZ 388-PBGA
標(biāo)準(zhǔn)包裝： 500
系列： MPC5xx
核心處理器： PowerPC
芯體尺寸： 32-位
速度： 66MHz
連通性： CAN，EBI/EMI，SCI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 64
程序存儲器類型： ROMless
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 2.7 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 32x10b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 388-BBGA
包裝： 帶卷 (TR)
配用： MPC564EVB-ND - KIT EVAL FOR MPC561/562/563/564
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MPC561/MPC563 Reference Manual, Rev. 1.2
RegIndex-4
Freescale Semiconductor
SCCxR1 (QSMCM SCI control register 1)
SCDR (QSMCM SCI data register)
SCxSR (QSMCM SCIx status register)
SPCR0 (QSPI control register 0)
SPCR1 (QSPI control register 1)
SPCR2 (QSPI control register 2)
SPCR3 (QSPI control register)
SPRG0-SPRG3 (general special-purpose registers
0-3)
SPSR (QSPI status register)
SRR0 (machine status save/restore register 0)
TBREF1 (time base reference register 1)
TICR (TPU3 interrupt configuration register)
TPUMCR (TPU3 module configuration register)
TPUMCR2 (TPU3 module configuration register 2)
TPUMCR3 (TPU3 module configuration register 3)
UC3FCFIG (hard reset configuration word)
UC3FCTL (UC3F EEPROM high voltage control reg-
ister
UIPEND (UIMB pending interrupt reqiuest register)
UMCR (UIMB module configuration register)
XER (integer exception register)
Registers
Associated registers
BAR (breakpoint address register)
BBCMCR (BBC module configuration register)
BR0 - BR3 (memory controller base registers 0-3)
Breakpoint counter B value and control register
(COUNTB)
CALRLAM_OTR (CALRAM ownership trace regis-
ter)
CMPA-CMPD (comparator A-D value registers )
CMPE-CMPF (comparator E-F value registers)
CMPG-CMPH (comparator G-H value registers)
COLIR (change of lock register)
COUNTA (breakpoint counter A value and control
register)
COUNTB (breakpoint counter B value and control
register)
CRAM_RBAx (CALRAM region base address regis-
ter)
CRAMMCR (CALRAM module configuration regis-
ter)
CRAMOVL (CALRAM overlay configuration regis-
ter)
DEC (decrementer register)
DER (debug enable register)
DMBR (dual mapping base register)
DPDR (development port data register)
DPTRAM
module configuration register (DPTMCR)
ram base address register (RAMBAR)
Dual mapping option register
ECR (exception cause register)
EIBADR (external interrupt relocation table base ad-
dress register)
EMCR (external master control register)
General-Purpose I/O registers
GPDI (general-purpose data in register)
GPDO (general-purpose data out register)
ICTRL (I-bus support control register)
Internal memory map register
Keep alive power registers lock mechanism
L2U
global region attribute register (L2U_GRA)
module configuration register (L2U_MCR)
region attribute registers (L2U_RAx)
region base address registers (L2U_RBAx)
LCTRL1 (L-bus support control register 1)
LCTRL1 (L-bus support control register 2)
MBISM
interrupt registers
MCPSMSCR (MCPSM status/control register)
MDASMSCR (MDASM status/control register)
MI_GRA (global region attribute register)
MI_RA 1 - 3 (region base address registers (1 - 3))
MI_RBA 0 - 3 (region base address registers (0 - 3))
MIOS
bus interface (MBISM) Registers
MIOS1
interrupt
level
register
0
(MIOSLVL0)
(MIOS1LVL1)
interrupt
level
register
1
(MIOSLVL1)
(MIOS1LVL0)
module
and
version
number
register
(MIOS1VNR)
MIOS14ER0 interrupt enable register
MIOS14ER1interrupt enable register
MIOS14MCR (MIOS14 module configuration regis-
ter)
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PDF描述
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