參數(shù)資料
型號： MPC562MZP66R2
廠商： Freescale Semiconductor
文件頁數(shù)： 1342/1420頁
文件大?。?/td> 0K
描述： IC MPU 32BIT 66MHZ 388-PBGA
標準包裝： 500
系列： MPC5xx
核心處理器： PowerPC
芯體尺寸： 32-位
速度： 66MHz
連通性： CAN，EBI/EMI，SCI，SPI，UART/USART
外圍設備： POR，PWM，WDT
輸入/輸出數(shù)： 64
程序存儲器類型： ROMless
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 2.7 V
數(shù)據(jù)轉換器： A/D 32x10b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 388-BBGA
包裝： 帶卷 (TR)
配用： MPC564EVB-ND - KIT EVAL FOR MPC561/562/563/564
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Development Support
MPC561/MPC563 Reference Manual, Rev. 1.2
23-14
Freescale Semiconductor
When working in the masked mode, all internal breakpoints detected when MSR[RI] = 0 are lost.
Watchpoints detected in this case are not counted by the debug counters. Watchpoints detected are always
reported on the external pins, regardless of the value of MSR[RI].
Out of reset, the CPU is in masked mode. Programming the CPU to be in non-masked mode is done by
setting the BRKNOMSK bit in the LCTRL2 register. Refer to Section 23.6.10, “L-Bus Support Control
Register 2.” The BRKNOMSK bit controls all internal breakpoints (I-breakpoints and L-breakpoints).
23.2.1.5
Ignore First Match
In order to facilitate the debugger utilities “continue” and “go from x”, the ignore first match option is
supported for instruction breakpoints. When an instruction breakpoint is first enabled (as a result of the
first write to the instruction support control register or as a result of the assertion of MSR[RI] when
operating in the masked mode), the first instruction will not cause an instruction breakpoint if the ignore
first match (IFM) bit in the instruction support control register (ICTRL) is set (used for “continue”).
When the IFM bit is clear, every matched instruction can cause an instruction breakpoint (used for “go
from x”). This bit is set by the software and cleared by the hardware after the first instruction breakpoint
match is ignored. Load/store breakpoints and all counter generated breakpoints (instruction and load/store)
are not affected by this mode.
23.2.1.6
Generating Six Compare Types
Using the four compare types mentioned above (equal, not equal, greater than, less than) it is possible to
generate also two more compare types: greater than or equal and less than or equal.
Generating the greater than or equal compare type can be done by using the greater than compare
type and programming the comparator to the needed value minus 1.
Generating the less than or equal compare type can be done by using the less than compare type
and programming the comparator to the needed value plus 1.
This method does not work for the following boundary cases:
Less than or equal of the largest unsigned number (1111...1)
Greater than or equal of the smallest unsigned number (0000...0)
Less than or equal of the maximum positive number when in signed mode (0111...1)
Greater than or equal of the maximum negative number when in signed mode (1000...)
These boundary cases need no special support because they all mean ‘a(chǎn)lways true’ and can be programmed
using the ignore option of the load/store watchpoint programming (refer to Section 23.2, “Watchpoints and
23.2.2
Instruction Support
There are four instruction address comparators A,B,C, and D. Each is 30 bits long, generating two output
signals: equal and less than. These signals are used to generate one of the following four events: equal, not
equal, greater than, less than.
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PDF描述
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參數(shù)描述
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