參數(shù)資料
型號： MPC562MZP66R2
廠商： Freescale Semiconductor
文件頁數(shù)： 1332/1420頁
文件大?。?/td> 0K
描述： IC MPU 32BIT 66MHZ 388-PBGA
標準包裝： 500
系列： MPC5xx
核心處理器： PowerPC
芯體尺寸： 32-位
速度： 66MHz
連通性： CAN，EBI/EMI，SCI，SPI，UART/USART
外圍設(shè)備： POR，PWM，WDT
輸入/輸出數(shù)： 64
程序存儲器類型： ROMless
RAM 容量： 32K x 8
電壓 - 電源 (Vcc/Vdd)： 2.5 V ~ 2.7 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 32x10b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 388-BBGA
包裝： 帶卷 (TR)
配用： MPC564EVB-ND - KIT EVAL FOR MPC561/562/563/564
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Development Support
MPC561/MPC563 Reference Manual, Rev. 1.2
Freescale Semiconductor
23-5
Program trace can be used in various ways. Below are two examples of how program trace can be used:
Back trace — Back trace is useful when a record of the program trace before some event occurred
is needed. An example of such an event is some system failure.
In case back trace is needed the external hardware should start sampling the status pins (VF and
VFLS) and the address of all cycles marked with the program trace cycle attribute immediately
when reset is negated. If show cycles is programmed out of reset to show all, all cycles marked
with program trace cycle attribute are visible on the external bus. VSYNC should be asserted
sometime after reset and negated when the programmed event occurs. If no show is programmed
for show cycles, make sure VSYNC is asserted before the Instruction show cycles programming is
changed from show all.
Note that in case the timing of the programmed event is unknown it is possible to use cyclic buffers.
After VSYNC is negated the trace buffer will contain the program flow trace of the program
executed before the programmed event occurred.
Window trace — Window trace is useful when a record of the program trace between two events
is needed. In case window trace is needed the VSYNC pin should be asserted between these two
events.
After the VSYNC pin is negated the trace buffer will contain information describing the program
trace of the program executed between the two events.
23.1.4.1
Synchronizing the Trace Window to the CPU Internal Events
The assertion/negation of VSYNC is done using the serial interface implemented in the development port.
In order to synchronize the assertion/negation of VSYNC to an internal event of the CPU, it is possible to
use the internal breakpoints together with debug mode. This method is available only when debug mode
is enabled. For more information on debug mode refer to Section 23.3, “Development System Interface.”
The following is an example of steps that enable synchronization of the trace window to the CPU internal
events:
1. Enter debug mode, either immediately out of reset or using the debug mode request
2. Program the hardware to break on the event that marks the start of the trace window using the
3. Enable debug mode entry for the programmed breakpoint in the debug enable register (DER). See
4. Return to the regular code run (see Section 23.3.1.6, “Exiting Debug Mode”)
5. The hardware generates a breakpoint when the programmed event is detected and the machine
6. Program the hardware to break on the event that marks the end of the trace window
7. Assert VSYNC
8. Return to the regular code run. The first report on the VF pins is a VSYNC (VF = 011).
9. The external hardware starts sampling the program trace information upon the report on the VF
pins of VSYNC
10. The hardware generates a breakpoint when the programmed event is detected and the machine
enters debug mode
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PDF描述
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