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參數(shù)資料
| 型號： | S-7600A |
| 廠商： | Seiko Instruments Inc. |
| 英文描述： | Hardware Specification (TCP/IP Network Stack LSI) |
| 中文描述： | 硬件規(guī)格（TCP / IP網(wǎng)絡(luò)堆棧大規(guī)模集成電路） |
| 文件頁數(shù)： | 23/60頁 |
| 文件大小： | 371K |
| 代理商： | S-7600A |
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TCP/IP Network Stack LSI
S-7600A
Hardware Specification
Revision 1.3
Seiko Instruments Inc.
5-6
5.3. Serial Interface
This mode is selected by pulling the
PSX
input pin “L”. In this mode Bit 6 of the Data Bus is used as the
serial clock and bit 5 and 7 are used as Data Input and Data Output. Bit 0 to 4 are high impedance. By
pulling
WRITEX
signal to “H” or “L”, the MPU performs a read or write operation.
5.3.1. Write Cycle Timing
Figure 5-5
Serial Interface Write Timing
Symbol
T
CYCS
T
CLLS
T
CLHS
T
ASS
T
AHS
T
DSS
T
DHS
T
BDS
T
BCS
T
BODS
NOTES:
CLK is the clock of S-7600A
Timing is specified of 50% of the signal waveform.
Rise/fall time(20%,80%) of the input signal is 15nsec or less.
Table 5-7
Serial Interface Write Cycle Timing
Description
System Cycle Time
Clock L Time
Clocl H Time
Address Setup Time
Address Hold Time
Data Setup time
Data Hold Time
BUSYX Delay Time
BUSYX Pulse Width
BUSYX Output Disable Time
Min
100 ns
40ns
40 ns
20ns
20ns
20ns
20 ns
2CLK
Max
1.9CLK
Notes
CL=80pF
30ns
30ns
CL=80pF
CS
WRITEX
(R/WX)
CLK
BUSYX
SD6
(SCL)
RS
SD7
(SI)
T
AHS
T
ASS
T
BDS
T
BCS
A7
T
ASS
A6
A5
A4
A3
A2
A1
A0
T
AHS
T
CYCS
T
DSS
T
DHS
T
BODS
T
CLLS
T
CLHS
D7
D6
D5
D4
D3
D2
D1
D0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| S-80230AG | NEGATIVE VOLTAGE REGULATOR |
| S-80230AG-GA-S | NEGATIVE VOLTAGE REGULATOR |
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| S-80230AG-GA-T2 | NEGATIVE VOLTAGE REGULATOR |
| S-80250AG | NEGATIVE VOLTAGE REGULATOR |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| S760K | 功能描述:直流電源連接器 DC PWR PLG 0.080" 1.7"L, BLK HAND. LCK RoHS:否 制造商:Kycon 產(chǎn)品:Receptacles 觸點(diǎn)內(nèi)徑: 觸點(diǎn)外徑: 中心腳長度: 電流額定值:7.5 A 電壓額定值:20 V 安裝角:Right 安裝風(fēng)格:Cable |
| S760K | 制造商:Switchcraft 功能描述:JACK PLUG DC |
| S76121P | 制造商:SUNTAC 制造商全稱:SUNTAC 功能描述:47A, 30V, 0.021 OHM, N-CHANNEL, LOGIC LEVEL ULTRAFET POWER MOSFETS |
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