參數(shù)資料
型號: MC705C9ACPE
廠商: Freescale Semiconductor
文件頁數(shù): 4/118頁
文件大小: 0K
描述: IC MCU 2.1MHZ 16K OTP 40-DIP
標(biāo)準(zhǔn)包裝: 9
系列: HC05
核心處理器: HC05
芯體尺寸: 8-位
速度: 2.1MHz
連通性: SCI,SPI
外圍設(shè)備: POR,WDT
輸入/輸出數(shù): 24
程序存儲器容量: 16KB(16K x 8)
程序存儲器類型: OTP
RAM 容量: 352 x 8
電壓 - 電源 (Vcc/Vdd): 3 V ~ 5.5 V
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 40-DIP(0.600",15.24mm)
包裝: 管件
3.3-Vdc Control Timing
MC68HC05C9A Advance Information Data Sheet, Rev. 4.1
Freescale Semiconductor
101
Figure 12-7. Power-On Reset Timing Diagram
Figure 12-8. External Reset Timing
3FFE
4064 t
CYC
V
DD
OSC1 PIN(2)
INTERNAL
CLOCK(3)
INTERNAL
DATA BUS(3)
3FFE
3FFF
(NOTE 1)
1. Power-on reset threshold is typically between 1 V and 2 V.
3. Internal clock, internal address bus, and internal data bus are not available externally.
NEW
PCH
NEW
PCL
2. OSC1 line is meant to represent time only, not frequency.
4. RESET outputs VOL during 4064 POR cycles.
Notes:
RESET PIN
(NOTE 4)
INTERNAL
ADDRESS BUS(3)
INTERNAL
CLOCK(1)
INTERNAL
ADDRESS BUS(1)
Notes:
INTERNAL
DATA BUS(1)
3FFE
3FFF
NEW PC
1. Internal clock, internal address bus, and internal data bus are not available externally.
2. The next rising edge of the internal clock after the rising edge of RESET initiates the reset sequence.
NEW
PCH
t
RL
NEW
PCL
OP
CODE
RESET(2)
3FFE
相關(guān)PDF資料
PDF描述
2-6457567-2 ADPTR,DUP,LC,SR BLU,CER,LOGO
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