參數(shù)資料
型號： MAX5898EGK+D
廠商： Maxim Integrated Products
文件頁數(shù)： 10/33頁
文件大小： 0K
描述： IC DAC 16BIT DUAL 500MSPS 68-QFN
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 30
設(shè)置時間： 11ns
位數(shù)： 16
數(shù)據(jù)接口： 并聯(lián)
轉(zhuǎn)換器數(shù)目： 2
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 831mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 68-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝： 68-QFN 裸露焊盤（10x10）
包裝： 管件
輸出數(shù)目和類型： 2 電流，單極
采樣率（每秒）： 500M
MAX5898
16-Bit, 500Msps, Interpolating and Modulating
Dual DAC with Interleaved LVDS Inputs
18
______________________________________________________________________________________
DATACLK Modes
The MAX5898 employs a differential LVDS DATACLK
located at pins 4 and 5. The DATACLK can be config-
ured as either an input or as an output (bit 3, address
02h). If DATACLK is configured as an output, it is fre-
quency-divided from the CLKP/CLKN input, depending
on the operating mode, see Table 4.
The MAX5898 can be configured to latch the input
data on either the rising edge or falling edge of the
DATACLK signal (bit 4, address 02h). Figure 4 shows
the timing requirements between the DATACLK signal
and the input data bus with latching on the rising edge.
INTERPOLATION
RATE
fDATA:fCLK
fDAC:fCLK
1x
1:1
1:2
2x
1:1
4x
1:2
1:1
8x
1:4
1:1
Table 4. Clock Frequency Ratios in
Various Modes
Figure 4. Data-Input Timing Diagram
tD
tDS
CLKP–CLKN
DATACLKP–DATACLKN
SELIQ
D0–D15
tDH
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PDF描述
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參數(shù)描述
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MAX5900AAETT+ 制造商:Maxim Integrated Products 功能描述:SIMPLE SWAPPER HOT-SWAP CONTROLLER - Rail/Tube
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