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參數(shù)資料
| 型號(hào)： | M30853MW-XXXFP |
| 元件分類(lèi)： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 32 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁(yè)數(shù)： | 76/542頁(yè) |
| 文件大?。?/td> | 3577K |
| 代理商： | M30853MW-XXXFP |
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14. DMACII
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14. DMAC II
DMAC II performs memory-to-memory transfer, immediate data transfer and calculation transfer, which
transfers the sum of two data added by an interrupt request from any peripheral functions.
Table 14.1 lists specifications of DMAC II.
Table 14.1 DMAC II Specifications
Item
Specification
DMAC II Request Source
Interrupt requests generated by all peripheral functions when the ILVL2 to
ILVL0 bits are set to "1112"
Transfer Data
Data in memory is transferred to memory (memory-to-memory transfer)
Immediate data is transferred to memory (immediate data transfer)
Data in memory (or immediate data) + data in memory are transferred to
memory (calculation transfer)
Transfer Block
8 bits or 16 bits
Transfer Space
64-Kbyte space in addresses 0000016 to 0FFFF16(1, 2)
Transfer Direction
Fixed or forward address
Selected separately for each source address and destination address
Transfer Mode
Single transfer, burst transfer
Chained Transfer Function Parameters (transfer count, transfer address and other information) are
switched when transfer counter reaches zero
End-of-Transfer Interrupt
Interrupt occurs when a transfer counter reaches zero
Multiple Transfer Function
Multiple data can be transferred by a generated request for one DMAC II transfer
NOTES:
1. When transferring a 16-bit data to destination address 0FFFF16, it is transferred to 0FFFF16 and
1000016. The same transfer occurs when the source address is 0FFFF16.
2. The actual space where transfer can occurs is limited due to internal RAM capacity.
14.1 DMAC II Settings
DMAC II can be made available by setting up the following registers and tables.
RLVL register
DMAC II Index
Interrupt control register of the peripheral function causing a DMAC II request
The relocatable vector table of the peripheral function causing a DMAC II request
IRLT bit in the IIOiIE register (i = 0 to 5, 8 to 11) if using the intelligent I/O or CAN interrupt
Refer to 11. Interrupts for details on the IIOiIE register.
14.1.1 RLVL Register
When the DMAII bit is set to "1" (DMAC II transfer) and the FSIT bit to "0" (normal interrupt), DMAC II is
activated by an interrupt request from any peripheral function with the ILVL2 to ILVL0 bits in the interrupt
control register set to "1112" (level 7).
Figure 14.1 shows the RLVL register.
相關(guān)PDF資料 |
PDF描述 |
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| M30853FWTGP | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| M30853FHTGP | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| M30853MW-XXXGP | 32-BIT, MROM, 32 MHz, MICROCONTROLLER, PQFP100 |
| M30855FJGP | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP144 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| M30855FHGP | 制造商:RENESAS 制造商全稱(chēng):Renesas Technology Corp 功能描述:SINGLE-CHIP 16/32-BIT CMOS MICROCOMPUTER |
| M30855FHGP D3 | 制造商:Renesas Electronics Corporation 功能描述: |
| M30855FHGP#D3 | 制造商:Renesas Electronics Corporation 功能描述:MCU 16BIT R8C CISC 384KB FLASH 5V 144LQFP - Trays |
| M30855FHGP#D5 | 制造商:Renesas Electronics Corporation 功能描述:MCU 16BIT R8C CISC 384KB FLASH 5V 144LQFP - Trays |
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