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參數(shù)資料
| 型號(hào)： | M30853MW-XXXFP |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, MROM, 32 MHz, MICROCONTROLLER, PQFP100 |
| 封裝： | 14 X 20 MM, 0.65 MM PITCH, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 184/542頁 |
| 文件大?。?/td> | 3577K |
| 代理商： | M30853MW-XXXFP |
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Page 241
4
9
4
f
o
5
0
2
,
1
0
.
l
u
J
3
0
.
1
.
v
e
R
3
0
1
0
-
7
3
0
B
9
0
J
E
R
17. Serial I/O (Special Function)
)
T
5
8
/
C
2
3
M
,
5
8
/
C
2
3
M
(
p
u
o
r
G
5
8
/
C
2
3
M
Figure 17.29 SIM Interface Operation
D0 D1
D2 D3 D4 D5 D6 D7
ST
P
D0 D1 D2 D3 D4 D5 D6 D7
ST
P
SP
D0 D1
D2 D3 D4 D5 D6
D7
ST
P
D0 D1 D2 D3
D4 D5 D6
D7
ST
P
SP
D0 D1
D2 D3 D4 D5 D6
D7
ST
P
D0 D1 D2 D3
D4 D5 D6
D7
ST
P
SP
D0 D1
D2 D3 D4 D5 D6 D7
ST
P
D0
D1
D2 D3 D4 D5 D6
D7
ST
P
SP
Start
bit
Parity
bit
"0"
"1"
"0"
"1"
"0"
"1"
Set to "0" by an interrupt request acknowledgement or by program
Tc
Transfer Clock
Stop
bit
Data is written to
the UARTi register
An "L" signal is applied from the SIM
card due to a parity error
An interrupt routine
detects "H" or "L"
TxDi
"0"
"1"
Transfer Clock
Read the UiRB register
Signal Line Level(3)
TxDi
Signal Line Level(2)
NOTES:
1. Data transmission starts when BRG overflows after a value is set to the UiTB register on the rising edge of the TI bit.
2. Because the TxDi and RxDi pins are connected, a composite waveform, consisting of transmit waveform from the TxDi
pin and parity error signal from the receiving end, is generated.
3. Because the TxDi and RxDi pins are connected, a composite waveform, consisting of transmit waveform from the
transmitting end and parity error signal from the TxDi pin, is generated.
4. The CNT3 to CNT0 bits in the TCSPR register selects no division (n=0) or divide-by-2n (n=1 to 15).
Data is transferred from the UiTB
register to the UARi transmit register
(Note 1)
RE bit in UiC1
register
RI bit in UiC1
register
IR bit in SiRIC
register
TE bit in UiC1
register
TI bit in UiC1
register
TXEPT bit in
UiC0 register
IR bit in SiTIC
register
i=0 to 4
The above applies to the following settings :
The PRYE bit in the UiMR register is set to "1" (parity enabled)
The STPS bit in the UiMR register is set to "0" (1 stop bit)
The UiIRS bit in the UiC1 register is set to "1" (interrupt request generated
when transmission completed)
Tc = 16(m+1) / fj
fj : count source frequency of the UiBRG register (f1, f8, f2n(4))
m : setting value of the UiBRG register
Start
bit
Set to "0" by an interrupt request acknowledgement or by program
Stop
bit
TxDi outputs "L" due to
a parity error
i=0 to 4
The above applies to the following settings :
The PRYE bit in the UiMR register is set to "1" (parity enabled)
The STPS bit in the UiMR register is set to "0" (1 stop bit)
Tc = 16(m+1) / fj
fj : count source frequency of the UiBRG register (f1, f8, f2n(4))
m : setting value of the UiBRG register
Parity
bit
"0"
"1"
"0"
"1"
(1) Transmit Timing
(2) Receive Timing
Parity Error Signal
returned from
Receiving End
Transmit Waveform
from the
Transmitting End
"1"
SP
An interrupt routine detects
"H" or "L"
SP
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| M30855FWTGP | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP144 |
| M30853FWTGP | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| M30853FHTGP | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP100 |
| M30853MW-XXXGP | 32-BIT, MROM, 32 MHz, MICROCONTROLLER, PQFP100 |
| M30855FJGP | 32-BIT, FLASH, 32 MHz, MICROCONTROLLER, PQFP144 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| M30853MW-XXXGP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 16/32-BIT CMOS MICROCOMPUTER |
| M30855FHGP | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:SINGLE-CHIP 16/32-BIT CMOS MICROCOMPUTER |
| M30855FHGP D3 | 制造商:Renesas Electronics Corporation 功能描述: |
| M30855FHGP#D3 | 制造商:Renesas Electronics Corporation 功能描述:MCU 16BIT R8C CISC 384KB FLASH 5V 144LQFP - Trays |
| M30855FHGP#D5 | 制造商:Renesas Electronics Corporation 功能描述:MCU 16BIT R8C CISC 384KB FLASH 5V 144LQFP - Trays |
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