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參數(shù)資料
| 型號： | KXPC8240LVV200E |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 50/52頁 |
| 文件大小： | 0K |
| 描述： | IC MPU INTEGRATED 250MHZ 352TBGA |
| 標(biāo)準(zhǔn)包裝： | 2 |
| 系列： | MPC82xx |
| 處理器類型： | 32-位 MPC82xx PowerQUICC II |
| 速度： | 200MHz |
| 電壓： | 2.5V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 352-LBGA |
| 供應(yīng)商設(shè)備封裝： | 352-TBGA（35x35） |
| 包裝： | 托盤 |
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MPC8240 Integrated Processor Hardware Specifications
7
Electrical and Thermal Characteristics
Figure 2 shows the supply voltage sequencing and separation cautions.
Figure 2. Supply Voltage Sequencing and Separation Cautions
OVDD/GVDD/(LVDD @ 3.3 V - - - -)
VDD/AVDD/AVDD2/LAVDD
LVDD @ 5 V
Time
3.3 V
5 V
2.5 V
0
7
10
9
10
6,8
DC
Po
we
rSu
p
ly
V
o
lt
a
g
e
Voltage
Regulator
Delay
Reset
Configuration Pins
HRST_CPU and
HRST_CTRL
PLL
Relock
Time 2
100 s
9 External Memory
Asserted 255
External Memory
HRST_CPU and
HRST_CTRL
VDD Stable
Power Supply Ramp Up
See Note 1
Clock Cycles 2
Clock Cycles Setup Time 3
VM = 1.4 V
One External Memory Clock Cycle 4
Maximum Rise Time Must be Less Than
Notes:
1. Numbers associated with waveform separations correspond to caution numbers listed in Table 2.
2. Refer to Table 7 for additional information on PLL relock and reset signal assertion timing requirements.
3. Refer to Table 8 for additional information on reset configuration pin setup timing requirements.
4. For the device to be in the non-reset state, HRST_CPU/HRST_CTRL must transition from a logic 0 to a
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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