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參數(shù)資料
| 型號： | IDT5V9885TPFGI |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 34/39頁 |
| 文件大小： | 0K |
| 描述： | IC CLOCK GEN PLL 500MHZ 32TQFP |
| 標準包裝： | 250 |
| 類型： | * |
| PLL： | 帶旁路 |
| 輸入： | LVCMOS，LVTTL |
| 輸出： | LVCMOS，LVDS，LVPECL，LVTTL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:6 |
| 差分 - 輸入:輸出： | 無/是 |
| 頻率 - 最大： | 500MHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-LQFP |
| 供應(yīng)商設(shè)備封裝： | 32-TQFP（7x7） |
| 包裝： | 管件 |
| 其它名稱： | 800-2579 |
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4
INDUSTRIALTEMPERATURERANGE
IDT5V9885T
3.3V EEPROMPROGRAMMABLECLOCKGENERATOR
PIN DESCRIPTION
PF32
NL28
Pin Name
Pin#
I/O
Type
Description
CLKIN
1
I
LVTTL
Input Clock
XTALIN/REFIN
4
I
LVTTL
CRYSTAL_IN - Reference crystal input or external reference clock input
XTALOUT
5
O
LVTTL
CRYSTAL_OUT -Reference crystal feedback
GIN0/SDAT/TDI
19
16
I
LVTTL(1,2)
Multi-purposeinputs. CanbeusedforFrequencyControl,SDAT(I2C),orTDI(JTAG).
GIN1/SCLK/TCK
20
17
I
LVTTL(1,2)
Multi-Purposeinputs. CanbeusedforFrequencyControl,SCLK(I2C),orTCK(JTAG).
GIN2/TMS
24
21
I
LVTTL(1,2)
Multi-Purpose inputs. Can be used for Frequency Control or TMS (JTAG)
GIN3/SUSPEND
27
23
I
LVTTL(1,2)
Multi-Purposeinputs. CanbeusedforFrequencyControlorasasuspendmodecontrol
input (active HIGH).
GIN4/TRST
25
22
I
LVTTL(1,2)
Multi-Purpose inputs. Can be used for Frequency Control or TRST (JTAG)
GIN5/CLK_SEL
21
18
I
LVTTL(1,2)
Multi-Purpose inputs. Can be used for Frequency Control or input clock selector.
SHUTDOWN/OE
28
24
I
LVTTL(1,2)
Enables/disablestheoutputsorpowersdownthechip.TheSPbit(0x1C)controlsthe
polarity of the signal to be either active HIGH or LOW. (Default is active HIGH.)
I2C/JTAG
22
19
I
3-level(3)
I2C (HIGH) or MFC Mode (MID) or JTAG Programming (LOW)
OUT1
6
O
LVTTL
Configurable clock output 1. Can also be used to buffer the reference clock.
OUT2
29
25
O
LVTTL
Configurable clock output 2
OUT3
8
7
O
LVTTL
Configurable clock output 3
OUT4
10
8
O
Adjustable(4)
Configurableclockoutput4,Single-EndedorDifferentialwhencombinedwithOUT4
OUT4
11
9
O
Adjustable(4)
Configurable complementary clock output 4, Single-Ended or Differential when
combined with OUT4
OUT5
15
13
O
Adjustable(4)
Configurableclockoutput5,Single-EndedorDifferentialwhencombinedwithOUT5
OUT5
16
14
O
Adjustable(4)
Configurable complementary clock output 5, Single-Ended or Differential when
combined with OUT5
OUT6
13
11
O
LVTTL
Configurable clock output 6
GOUT0/TDO/LOSS_LOCK
31
27
O
LVTTL(1)
Multi-PurposeOutput.CanbeprogrammedtouseasPLLLOCKsignal,LOSS_LOCK
or TDO in JTAG mode
GOUT1/LOSS_CLKIN
3
O
LVTTL
Multi-Purpose Output. Can be programmed to use as LOSS_CLKIN
VDD
7,12,17,
10,15,20
3.3V Power Supply
23,26,32
28
GND
2,9,14,
2,12,26
Ground
18,30
NOTES:
1. The JTAG (TDO, TMS, TCLK, TRST, and TDI) and I2C (SCLK and SDAT) signals share the same pins with GIN signals.
2. Weak internal 100K pull-down resistor.
3. 3-level inputs are static inputs and must be tied to VDD or GND or left floating. These inputs are internally biased to VDD/2. They are not hot-insertable or over voltage tolerant.
4. Outputs are user programmable to drive single-ended 3.3V LVTTL, differential LVDS, or differential LVPECL interface levels.
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PDF描述 |
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參數(shù)描述 |
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