參數(shù)資料
型號(hào)： IDT5V9885TPFGI
廠商： IDT, Integrated Device Technology Inc
文件頁(yè)數(shù)： 28/39頁(yè)
文件大?。?/td> 0K
描述： IC CLOCK GEN PLL 500MHZ 32TQFP
標(biāo)準(zhǔn)包裝： 250
類型： *
PLL： 帶旁路
輸入： LVCMOS，LVTTL
輸出： LVCMOS，LVDS，LVPECL，LVTTL
電路數(shù)： 1
比率 - 輸入:輸出： 2:6
差分 - 輸入:輸出： 無(wú)/是
頻率 - 最大： 500MHz
除法器/乘法器： 是/無(wú)
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-LQFP
供應(yīng)商設(shè)備封裝： 32-TQFP（7x7）
包裝： 管件
其它名稱： 800-2579
34
INDUSTRIALTEMPERATURERANGE
IDT5V9885T
3.3V EEPROMPROGRAMMABLECLOCKGENERATOR
RAM (PROGRAMMING REGISTER) TABLES
ADDR
7
6
5
4
3
2
1
0
Register
Hex Value
7
6
5
4
3
2
1
0
0x40
0
00
0x41
0
00
0x42
0
00
0x43
0
00
0x44
0
00
0x45
0
00
0x46
0
00
0x47
0
00
0x48
0
00
0x49
0
00
0x4A
0
00
0x4B
0
00
0x4C
0
00
INV2
0x4D
1
0
1
0
1
BB
0x4E
0
00
0x4F
0
00
0x50
0
00
INV 3
0x51
1
0
1
0
1
BB
0x52
0
00
0x53
0
00
BIT #
Q2[1:0]_CONFIG1
D2 [7:0]_CONFIG1
Q2[9:2]_CONFIG0
D2 [7:0]_CONFIG2
PM2[1:0]_CONFIG1
PM2[1:0]_CONFIG0
SLEW2[1:0]
N2[11:8]_CONFIG1
PM3[1:0]_CONFIG1
Q3[1:0]_CONFIG0
PM3[1:0]_CONFIG0
Q3[9:2]_CONFIG1
N2[11:8]_CONFIG3
N2[11:8]_CONFIG2
Q2[9:2]_CONFIG1
OEM2[1:0]
Q3[9:2]_CONFIG0
SLEW3[1:0]
OEM3[1:0]
N2[11:8]_CONFIG0
N2 [7:0]_CONFIG0
D2 [7:0]_CONFIG3
N2 [7:0]_CONFIG3
D2 [7:0]_CONFIG0
N2 [7:0]_CONFIG2
N2 [7:0]_CONFIG1
Q2[1:0]_CONFIG0
Q3[1:0]_CONFIG1
0x54
0
1
0
0C
INV4_1
INV4_0
0x55
1
0
1
0
1
BB
0x56
0
00
0x57
0
00
0x58
0
1
0
0C
INV5_1
INV5_0
0x59
1
0
1
0
1
BB
0x5A
0
00
0x5B
0
00
0x5C
0
1
03
INV6
0x5D
1
0
1
0
1
BB
0x5E
0
00
0x5F
0
00
Q5[9:2]_CONFIG1
SLEW6[1:0]
Q6[9:2]_CONFIG1
PM6[1:0]_CONFIG0
PM6[1:0]_CONFIG1
Q6[1:0]_CONFIG1
Q5[1:0]_CONFIG0
Q6[9:2]_CONFIG0
OEM6[1:0]
PM5[1:0]_CONFIG1
PM5[1:0]_CONFIG0
Q5[9:2]_CONFIG0
Q5[1:0]_CONFIG1
Q6[1:0]_CONFIG0
SLEW5[1:0]
OEM5[1:0]
Q4[9:2]_CONFIG0
LVL4[1:0]
LVL5[1:0]
Q4[9:2]_CONFIG1
PM4[1:0]_CONFIG1
SLEW4[1:0]
Q4[1:0]_CONFIG0
OEM4[1:0]
Q4[1:0]_CONFIG1
PM4[1:0]_CONFIG0
DES CRIPTION
P LL2 INPUT DIVIDER D2 SE TTING
Configuring Output OUT3
INV3=Output Inversion for OUT3 ("0"= Non-Invert (Default), "1"=Invert);
S LEW3=Slew Rate Settings for OUT3 output ("00"= 2.75V/ns (Default), " 01"=2V/ns, "10"=1.25V/ns, " 11"=0.7V/ns);
INVx
PMx
OEMx
Qx
SLEWx
Configuring Output OUT2
INV2=Output Inversion for OUT2 ("0"= Non-Invert (Default), "1"=Invert);
S LEW2=Slew Rate Settings for OUT2 output ("00"= 2.75V/ns (Default), " 01"=2V/ns, "10"=1.25V/ns, " 11"=0.7V/ns);
INV5_1=Output Inversion for /OUT5 (" 0"= Invert, " 1"=Non-Invert (Default));
INV5_0=Output Inversion for OUT5 ("0"= Invert, "1"=Non-Invert (Default));
S LEW5=Slew rate settings for OUT5 output ("00"= 2.75V/ns (Defa ult), "0 1"=2V/ns, " 10"=1.25V/ns, "11"=0.7V/ns);
OE M5= Output Enable Mode for OUT5 output, when used with OE5 bit and SHUTDOWN/OE pin ("0x" = Tri-state (Default), " 10"=Park
Low, "11"=Park High);
LVL5=Output IO Stan dard Selection, ("00"=LVTTL (Default), "01"=LVDS, "10"=LV PECL, "11"=Reserved);
Q5[x:x]=Output Divider "Q5" Values (Default value is '2') - Support 2 output configurations when used in MFC mode;
P M5[x:x]=Divide Mode, ("00"=Divider Disabled;"01" =Divide by '1';"10"=Divide by 2; "11"=Divide by (Q+2) (Default));
(Note : To enable OUT5, PM5 register bit values for both CONFIG0 and CONFIG1 configurations must be non-zero.)
P LL2 MULTIPLIER SETTING
Total Multiplier Value
Configuring Output OUT5
INV5_1=Output Inversion for /OUT5 ("0"= Invert, " 1"=Non-Invert (Default));
INV5_0=Output Inversion for OUT5 ("0"= Invert, "1"= Non-Invert (Default));
When using LVPE CL or LVDS outputs, SLE W5 must be set to '00'.
Configuring Output OUT4
INV4_1=Output Inversion for /OUT4 ("0"= Invert , "1" =Non-Invert (Default));
INV4_0=Output Inversion for OUT4 ("0"= Invert , " 1"=Non-Invert (Default));
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PDF描述
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IDT5V9888NLGI 功能描述:IC CLK GEN 3.3V EEPROM 28-VFQFPN RoHS:是 類別:集成電路 (IC) >> 時(shí)鐘/計(jì)時(shí) - 時(shí)鐘發(fā)生器，PLL，頻率合成器 系列:- 標(biāo)準(zhǔn)包裝:39 系列:- 類型:* PLL:帶旁路 輸入:時(shí)鐘 輸出:時(shí)鐘 電路數(shù):1 比率 - 輸入:輸出:1:10 差分 - 輸入:輸出:是/是 頻率 - 最大:170MHz 除法器/乘法器:無(wú)/無(wú) 電源電壓:2.375 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:* 封裝/外殼:* 供應(yīng)商設(shè)備封裝:* 包裝:*
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IDT5V9888TNLGI 制造商:Integrated Device Technology Inc 功能描述:IC CLOCK GEN PLL 500MHZ 28-VFQFP
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