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參數(shù)資料
| 型號： | HM17CM4096 |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 128XRGBX162 OUTPUT LCD DRIVER IC with built-in RAM |
| 中文描述： | 128XRGBX162輸出LCD驅動器內置內存 |
| 文件頁數(shù)： | 29/67頁 |
| 文件大?。?/td> | 1117K |
| 代理商： | HM17CM4096 |
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HM17CM4096
- 29 -
(11) display data structure and gradation control
For the purpose of gradation control, information per pixel requires multiple bits. This IC has 4 bit
per output to achieve the gradation display.
This IC is connected to an STN color LCD panel by three segment port units and one pixel consists
of three outputs of segment driver, and so 4096 color ( 4 bits x 4 bits x 4 bits ) display on 128 x 162
pixels is realized.
Since one pixel data can be processed by one time access to memory, the data can be rewritten
fast and naturally.
The weight of each data bit is dependent on the status of SWAP register bit and REF register
when data is written to the display RAM.
ACCESS when (REF, SWAP)=(0, 0) or (1, 1)
SEGAi
notice) internal access X address :n
H
~7F
H
(access when REF=”0”)
:7F
H
~n
H
(access when REF=”1”)
ACCESS when (REF, SWAP)=(0, 1) or (1, 0)
SEGAi
notice) internal access X address :n
H
~7F
H
(access when REF=”0”)
:7F
H
~n
H
(access when REF=”1”)
SEGBi
S
Aj
Palette Bj
Palette Aj
SEGCi
Palette Cj
MSB LSB
MSBLSB
MSB
Gradation palette
j=0~15
i=0~127
CPU access data
X address :n
H
Gradation
control circuit.
Display RAM data
LSB
0
D
1
1
D
15
1
D
7
1
1
0
D
3
0
D
4
0
D
8
0
1
D
13
1
D
14
0
0
1
1
1
1
0
0
0
0
1
1
0
D
10
D
12
D
2
D
9
SEGBi
S
Aj
Palette Bj
Palette Cj
SEGCi
Palette Aj
LSB MSB
LSB MSB
LSB
Gradation palette
j=0~15
i=0~127
CPU access data
X address :n
H
Gradation
control circuit.
Display RAM data
MSB
0
D
1
1
D
15
1
D
7
1
1
0
D
3
0
D
4
0
D
8
0
1
D
13
1
D
14
0
D
2
1
0
0
0
0
1
1
1
1
0
0
1
D
10
D
12
D
9
相關PDF資料 |
PDF描述 |
|---|---|
| HM18-40004 | EE Style Common-Mode Chokes |
| HM18 | EE Style Common-Mode Chokes |
| HM18-10001 | EE Style Common-Mode Chokes |
| HM18-10002 | EE Style Common-Mode Chokes |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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