參數(shù)資料
型號: FDC37B72X
廠商: STANDARD MICROSYSTEMS CORP
元件分類: 外設(shè)及接口
英文描述: 128 Pin Enhanced Super I/O Controller with ACPI Support
中文描述: MULTIFUNCTION PERIPHERAL, PQFP128
封裝: QFP-128
文件頁數(shù): 11/244頁
文件大?。?/td> 1037K
代理商: FDC37B72X
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11
GENERAL PURPOSE I/O PINS
TABLE 3 - GENERAL PURPOSE I/O PIN FUNCTIONS
ALTERNATE
FUNCTION 1
FUNCTION 2
nSMI
-
PIN NO.
QFP
77
DEFAULT
FUNCTION
GPIO
ALTERNATE
ALTERNATE
FUNCTION 3
-
BUFFER
TYPE
5
IOP4/(OP12/
OD12)
IOP4/I/I
IOP4/O4/IO4/I
IOP4/O24
IOP4/I
IOP4/O24
(O24/OD24)/
IOP4
(O24/OD24)/
IOP4
CLKIN/(O12/
OD12)/IOP4
(O24/OD24)
/IOP4/
(OP12/OD12)/
(OP12/OD12)
IO12/(O12/
OD12)/IOP4/I
IO12/(O12/
OD12)/IOP4/I
IO12/(O12/
OD12)/IOP4/
(OP12/OD12)
IO12/(O12/
OD12)/IOP4/
O24
IO12/(O12/
OD12)/IOP4/I
IO12/(O12/
OD12)/IOP4/
O4
IO12/(O12/
OD12)/IOP4/
IO4
IO12/(O12/
OD12)/IOP4
IO12/(OP12/
OD12)/IOP4
IO12/(O12/
OD12)/IOP4
INDEX
REG.
GP1
GPIO
GP10
78
79
80
81
82
4
GPIO
GPIO
GPIO
GPIO
GPIO
nMTR1
nRING
WDT
LED
IRRX2
IRTX2
GPIO
EETI
1
P17/P12
4
-
-
-
-
-
EETI
1
-
-
-
-
GP1
GP1
GP1
GP1
GP1
GP1
GP11
GP12
GP13
GP14
GP15
GP16
6
nDS1
GPIO
-
-
GP1
GP17
39
PCI_CLK
IRQ14
GPIO
-
GP5
GP50
2
DRVDEN1
GPIO
IRQ8
nSMI
GP5
GP52
91
nROMCS
2
IRQ11
GPIO
EETI
1
GP5
GP53
92
nROMOE
2
IRQ12
GPIO
EETI
1
GP5
GP54
83
RD0
2,3
IRQ1
GPIO
nSMI
GP6
GP60
84
RD1
2,3
IRQ3
GPIO
LED
GP6
GP61
85
RD2
2,3
IRQ4
GPIO
nRING
GP6
GP62
86
RD3
2,3
IRQ5
GPIO
WDT
GP6
GP63
87
RD4
2,3
IRQ6
GPIO
P17/P12
4
GP6
GP64
88
RD5
2,3
IRQ7
GPIO
-
GP6
GP65
89
RD6
2,3
IRQ8
GPIO
-
GP6
GP66
90
RD7
2,3
IRQ10
GPIO
-
GP6
GP67
Note 1: Either Edge Triggered Interrupt Inputs.
Note 2: At power-up, RD0-7, nROMCS and nROMOE function as the XD Bus. To use RD0-7 for
alternate functions, nROMCS must stay high until those pins are finished being programmed.
Note 3: These pins cannot be programmed as open drain pins in their original function.
Note 4: The function of P17 or P12 is selected via the P17/P12 select bit in the Ring Filter Select
Register in Logical Device 8 at 0xC6. Default is P17.
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