參數(shù)資料
型號(hào)： BU-66318G0-110
廠(chǎng)商： DATA DEVICE CORP
元件分類(lèi)： 微控制器/微處理器
英文描述： 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, PQFP208
封裝： 28 X 28 MM, 1.40 MM HEIGHT, LQFP-208
文件頁(yè)數(shù)： 7/32頁(yè)
文件大?。?/td> 278K
代理商： BU-66318G0-110
15
Data Device Corporation
www.ddc-web.com
BU-66318
B-09/05-0
1
2
3
4
5
6
PCI single write to PACE configuration space (C/BE# = Bh)
ADDRS
DATA
Bh
0ns
50ns
100ns
150ns
I
PCICLK
IO
AD[31:0]
I
C/BE[3:0]#
I
FRAME#
I
IRDY#
O
TRDY#
O
STOP#
O
DEVSEL#
I
IDSEL
FIGURE 6. PCI SINGLE WRITE TO CONFIGURATION SPACE
word onto the AD lines when only a single byte enable in the
word is asserted.
When reading ACE registers (BAR1 00-FCh), byte enable combi-
nations where only a single byte within a word is requested will
cause the ACE-Bridge to terminate the transaction with a target
abort. The ACE-Bridge will drive all zeros onto the AD lines if only
the upper word byte enables or no byte enables are asserted.
With relation to actual timing, PCI double word reads of ACE
memory (BAR0) will take longer to complete than single word
ACE memory reads because the local bus data path is 16 bits
wide. In addition, read cycles will take longer to complete with
slower ACE clocks. See TABLE 20 for min/max formulas for cal-
culating completion time for the various types of reads.
1
2
3
4
5
6
7
PCI read of PCI-ACE IF Registers (BAR1 800 - 81Ch)
A
ByteEnables
Ah
DATA
0ns
50ns
100ns
150ns
I
PCICLK
IO
I
C/BE[3:0]#
I
FRAME#
I
IRDY#
O
TRDY#
O
STOP#
O
DEVSEL#
FIGURE 7. PCI READ OF PCI-ACE IF REGISTERS (BAR1 800-81CH)
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PDF描述
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