TABLE 3-11. IEEE SPEED ABILITY REGISTER MII REGISTER 4, ADDRESSES = 04’h & 0004’h BIT NAME SETTING DEFAULT R/W DESCRIPTION 15:1 Reserved 00" />
參數(shù)資料
型號： BBT3420-SN
廠商： Intersil
文件頁數(shù)： 6/38頁
文件大小： 0K
描述： TXRX QUAD MULTI-RATE 289-EBGA
標(biāo)準(zhǔn)包裝： 84
類型： 收發(fā)器
驅(qū)動器/接收器數(shù)： 4/4
規(guī)程： XAUI，XGMII，MDC/MDIO
電源電壓： 1.7 V ~ 1.9 V
安裝類型： 表面貼裝
封裝/外殼： 289-BGA
供應(yīng)商設(shè)備封裝： 289-BGA（19x19）
包裝： 托盤
14
TABLE 3-11. IEEE SPEED ABILITY REGISTER
MII REGISTER 4, ADDRESSES = 04’h & 0004’h
BIT
NAME
SETTING
DEFAULT
R/W
DESCRIPTION
15:1
Reserved
000’h
RO
0
10G_Able
1 = 10Gbps Able
1’b
RO
10GE Capable
TABLE 3-12. IEEE DEVICES IN PACKAGE REGISTER
MII REGISTER 5, ADDRESSES = 05’h & 0005’h
BIT
NAME
SETTING
DEFAULT
R/W
DESCRIPTION
15:7
Reserved
000’h
RO
6
TC
TC present
0’b
RO
Device ignores DEVAD 6 (TC not present)
5
DTE XS
1 = DTE XGXS
P (Note 1)
RO
Device responds to DEVAD 5
4
PHY XS
1 = PHY XGXS
P (Note 1)
RO
Device responds to DEVAD 4
3
PCS
1 = PCS
0’b
RO
Device ignores DEVAD 3
2
WIS
1 = WIS
0’b
RO
Device ignores DEVAD 2
1
PMD/PMA
1 = PMD/PMA
0’b
RO
Device ignores DEVAD 1
0
Cls 22 Regs
1 = MDIO Clause 22
1’b
RO
Device responds to Clause 22
NOTE:
1. Value depends on DEVAD setting; see Table 3-5. 1 = responds, 0 = does not respond.
TABLE 3-13. VENDOR SPECIFIC DEVICES IN PACKAGE REGISTER
MII REGISTER 6, ADDRESSES = 06’h & 0006’h
BIT
NAME
SETTING
DEFAULT
R/W
DESCRIPTION
15
Vend Spec
1 = V S D present
S (Note 1)
RO
Vendor Specific Device Present in Package
14
Reserved
0’b
RO
13
Ext. Cls 22
0’b
RO
No extended Clause 22 registers in Package
12:0
Reserved
000’h
RO
NOTE:
1. Value depends on DEVAD setting; see Table 3-5. 1 = responds, 0 = does not respond.
TABLE 3-14. IEEE XGXS STATUS2 REGISTER
MII REGISTER 8, ADDRESSES = 08’h & 0008’h
BIT
NAME
SETTING
DEFAULT
R/W
DESCRIPTION
15:14
Device present 10 = Device present 10’b
RO
Indicates a device is present at this device address
13:12
Reserved
11
TX_FAULT
1 = Tx Local Fault
0’b
RO LH
(Note 1)
Transmit Fault Detector. Always 0
10
RX_FAULT
1 = Rx Local Fault
0’b
RO LH
(Note 1)
Derived from Reg. 0024’h, Byte Sync and Alignment bits (not
accessible via Clause 22), and 01’h/C009’h Loss Of Signal bits
9:0
Reserved
NOTE:
2. These bits are latched high on any fault condition detected. They are reset low upon being read.
BBT3420
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