參數(shù)資料
型號(hào)： AK4343EN
廠商： Asahi Kasei Microsystems Co.,Ltd
英文描述： Stereo DAC with HP/RCV/SPK-AMP
中文描述： 立體聲DAC惠普/垃圾車/胰腎聯(lián)合移植腺苷
文件頁數(shù)： 28/98頁
文件大?。?/td> 851K
代理商： AK4343EN
ASAHI KASEI
[AK4343]
MS0478-E-01
2006/10
- 28 -
PLL Slave Mode (AIN3 bit = “0”, PMPLL bit = “1”, M/S bit = “0”)
A reference clock of PLL is selected among the input clocks to MCKI, BICK or LRCK pin. The required clock to the
AK4343 is generated by an internal PLL circuit. Input frequency is selected by PLL3-0 bits (see Table 5).
a) PLL reference clock: MCKI pin
BICK and LRCK inputs should be synchronized with MCKO output. The phase between MCKO and LRCK dose not
matter. MCKO pin outputs the frequency selected by PS1-0 bits (see Table 10) and the output is enabled by MCKO bit.
Sampling frequency can be selected by FS3-0 bits (see Table 6).
AK4343
DSP or
μ
P
MCKO
BICK
LRCK
SDTI
BCLK
LRCK
SDTO
MCKI
1fs
≥
32fs
11.2896MHz, 12MHz, 12.288MHz
13.5MHz, 24MHz, 27MHz
MCLK
256fs/128fs/64fs/32fs
Figure 19. PLL Slave Mode 1 (PLL Reference Clock: MCKI pin)
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PDF描述
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