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參數(shù)資料
| 型號(hào)： | AK4343EN |
| 廠商： | Asahi Kasei Microsystems Co.,Ltd |
| 英文描述： | Stereo DAC with HP/RCV/SPK-AMP |
| 中文描述： | 立體聲DAC惠普/垃圾車/胰腎聯(lián)合移植腺苷 |
| 文件頁(yè)數(shù)： | 27/98頁(yè) |
| 文件大?。?/td> | 851K |
| 代理商： | AK4343EN |
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ASAHI KASEI
[AK4343]
MS0478-E-01
2006/10
- 27 -
PLL Master Mode (AIN3 bit = “0”, PMPLL bit = “1”, M/S bit = “1”)
When an external clock (11.2896MHz, 12MHz, 12.288MHz, 13.5MHz, 24MHz or 27MHz) is input to MCKI pin, the
MCKO, BICK and LRCK clocks are generated by an internal PLL circuit. The MCKO output frequency is selected by
PS1-0 bits (see Table 10) and the output is enabled by MCKO bit. The BICK output frequency is selected between 32fs or
64fs, by BCKO bit (see Table 11).
AK4343
DSP or
μ
P
MCKO
BICK
LRCK
SDTI
BCLK
LRCK
SDTO
MCKI
1fs
32fs, 64fs
256fs/128fs/64fs/32fs
11.2896MHz, 12MHz, 12.288MHz
13.5MHz, 24MHz, 27MHz
MCLK
Figure 18. PLL Master Mode
Mode
0
1
2
3
Table 10. MCKO Output Frequency (PLL Mode, MCKO bit = “1”)
PS1 bit
0
0
1
1
PS0 bit
0
1
0
1
MCKO pin
256fs
128fs
64fs
32fs
Default
BCKO bit
BICK Output
Frequency
32fs
64fs
0
1
Default
Table 11. BICK Output Frequency at Master Mode
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PDF描述 |
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