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參數(shù)資料
| 型號： | AFE7222IRGC25 |
| 廠商： | Texas Instruments |
| 文件頁數(shù)： | 99/106頁 |
| 文件大小： | 0K |
| 描述： | IC AFE 12BIT 65/130MSPS 64VQFN |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 位數(shù)： | 12 |
| 通道數(shù)： | 4 |
| 功率（瓦特）： | 610mW |
| 電壓 - 電源，模擬： | 2.85 V ~ 3.6 V |
| 電壓 - 電源，數(shù)字： | 1.7 V ~ 1.9 V |
| 封裝/外殼： | 64-VFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 64-VQFN 裸露焊盤（9x9） |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | 296-30067-6 |
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TO GET INTO DIRECT ACCESS
MODE
SDATA
SCLK
SEN
AUX DAC A INPUT1
0
1
0
1
DA11 DA10
DA9
DA8
DA7
DA6
DA5
DA4
DA3
DA2
DA1
DA0
AUXDAC_A
AUXDAC_B
DELAY FOR FIRST UPDATE = 34 CLOCKS
DA10
DA9
DA8
DA7
DA6
DA5
DA4
DA3
DA2
DA1
DA0
DA11
DA10
DA9
DA8
DA7
DA6
DA5
DA4
DA11
AUX DAC B INPUT1
tPER
tSETTLE
SLOS711B – NOVEMBER 2011 – REVISED MARCH 2012
Therefore fastest update time:
First update = 22*25ns + 40ns = 590 ns
Subsequent update = 12*25ns = 300 ns
For the direct access mode where DAC_A and DAC_B are both written through SDATA, the timing is
shown in figure below.
Figure 10-19. Aux DAC Timing Diagram: DAC_A and DAC_B are Both Written Through SDATA
Therefore fastest update time:
First update = 34*25ns + 40ns = 890 ns
Subsequent update = 24*25ns = 600 ns
After the first Aux DAC refresh, subsequent refresh of the Aux DAC outputs in the above mentioned direct
access mode takes place after every 24 clocks. Note that the Aux DAC takes about 12 mA on
AVDD3_AUX (when full scale output is set to 5 mA each Aux DAC).
10.11 Full Duplex Operation – Coupling Considerations
When operating the transmit and receive channels simultaneously, several factors need to be considered
in order to minimize the coupling between the transmit and receive channels. In a general case, the DAC
and ADC clocks can be at arbitrary rates, with or without harmonic relations to each other. In such a case,
there exist serious possibilities of coupling between the ADC and DAC. As far as possible, we recommend
driving the ADC and DAC with the same clock rate externally, and use the internal clock division and
multiplication to adjust to the required ADC and DAC clock rates internally.
The internal block diagram of the clocking path is repeated below.
92
DIGITAL INTERFACE
Copyright 2011–2012, Texas Instruments Incorporated
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| V48C2M50BF | CONVERTER MOD DC/DC 2V 50W |
| VE-J6D-MW-F3 | CONVERTER MOD DC/DC 85V 100W |
| V48C2M50BL3 | CONVERTER MOD DC/DC 2V 50W |
| VE-J6D-MW-F2 | CONVERTER MOD DC/DC 85V 100W |
| B37872K0474K062 | CAP CER 0.47UF 25V 10% X7R 1206 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| AFE7222IRGCR | 功能描述:射頻前端 Dual 12B,65MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 類型: 工作頻率:2.4 GHz, 5 GHz 最大數(shù)據(jù)速率:54 Mbps 噪聲系數(shù): 工作電源電壓:3.3 V 電源電流:180 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-32 |
| AFE7222IRGCT | 功能描述:射頻前端 Dual 12B,65MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 類型: 工作頻率:2.4 GHz, 5 GHz 最大數(shù)據(jù)速率:54 Mbps 噪聲系數(shù): 工作電源電壓:3.3 V 電源電流:180 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-32 |
| AFE7225 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Analog Front End Wideband Mixed-Signal Transceiver |
| AFE7225EVM | 功能描述:射頻開發(fā)工具 AFE7225 Eval Mod RoHS:否 制造商:Taiyo Yuden 產(chǎn)品:Wireless Modules 類型:Wireless Audio 工具用于評估:WYSAAVDX7 頻率: 工作電源電壓:3.4 V to 5.5 V |
| AFE7225IRGC25 | 功能描述:射頻前端 Dual 12B,125MSPS ADC RoHS:否 制造商:Skyworks Solutions, Inc. 類型: 工作頻率:2.4 GHz, 5 GHz 最大數(shù)據(jù)速率:54 Mbps 噪聲系數(shù): 工作電源電壓:3.3 V 電源電流:180 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-32 |
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