left justified, I
參數(shù)資料
型號(hào)： ADSP-21371BSWZ-2B
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 30/48頁(yè)
文件大?。?/td> 0K
描述： IC DSP 32BIT 266MHZ 208-LQFP
產(chǎn)品培訓(xùn)模塊： SHARC Processor Overview
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點(diǎn)
接口： DAI，DPI
時(shí)鐘速率： 266MHz
非易失內(nèi)存： ROM（512 kB）
芯片上RAM： 128kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.20V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 208-LQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 208-LQFP-EP（28x28）
包裝： 托盤
ADSP-21371
S/PDIF Transmitter
Serial data input to the S/PDIF transmitter can be formatted as
left justified, I2S, or right justified with word widths of 16-, 18-,
20-, or 24-bits. The following sections provide timing for the
transmitter.
S/PDIF Transmitter-Serial Input Waveforms
Figure 24 shows the right-justified mode. LRCLK is high for the
left channel and low for the right channel. Data is valid on the
rising edge of SCLK. The MSB is delayed 12-bit clock periods
(in 20-bit output mode) or 16-bit clock periods (in 16-bit output
DAI_P20-1
LRCLK
DAI_P20-1
SCLK
DAI_P20-1
SDATA
mode) from an LRCLK transition, so that when there are 64
SCLK periods per LRCLK period, the LSB of the data will be
right-justified to the next LRCLK transition.
LEFT CHANNEL
RIGHT CHANNEL
MS B-1
MSB-2
LSB+2 LSB+1
LSB
MSB
MSB-1
MSB-2
LS B+2
LSB+1
LSB
MSB
Figure 24. Right-Justified Mode
Figure 25 shows the default I2S-justified mode. LRCLK is low
for the left channel and HI for the right channel. Data is valid on
the rising edge of SCLK. The MSB is left-justified to an LRCLK
transition but with a single SCLK period delay.
DAI_P20-1
LRCLK
DAI_P20-1
SCLK
DAI_P20-1
SDATA
MSB-1
MS B-2
LS B+2
LSB+1
LSB
LEFT CHANNEL
MSB
MS B-1
MS B-2
LSB+2
LS B+1
LSB
MSB
RIGHT CHANNEL
Figure 25. I2S-Justified Mode
Figure 26 shows the left-justified mode. LRCLK is high for the
left channel and LO for the right channel. Data is valid on the
rising edge of SCLK. The MSB is left-justified to an LRCLK
transition with no MSB delay.
DAI_P20-1
LRCLK
DAI_P20-1
SCLK
DAI_P20-1
SDATA
LEFT CHANNEL
RIGHT CHANNEL
MSB-1
MSB-2
LS B+2
L SB+1
LSB
MSB
MSB-1
MSB-2
LSB+2
LSB +1
L SB
MSB
MSB+1
MSB
Figure 26. Left-Justified Mode
Rev. 0
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June 2007
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PDF描述
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