參數(shù)資料
型號： ADSP-21261SKSTZ150
廠商： Analog Devices Inc
文件頁數(shù)： 30/44頁
文件大?。?/td> 0K
描述： IC DSP 32BIT 150MHZ 144LQFP
產(chǎn)品培訓模塊： SHARC Processor Overview
標準包裝： 60
系列： SHARC®
類型： 浮點
接口： DAI，SPI
時鐘速率： 150MHz
非易失內(nèi)存： ROM（384 kB）
芯片上RAM： 128kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.20V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應商設備封裝： 144-LQFP（20x20）
包裝： 托盤
Rev. 0
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March 2006
ADSP-21261
JTAG Test Access Port and Emulation
Table 31. JTAG Test Access Port and Emulation
Parameter
Min
Max
Unit
Timing Requirements
tTCK
TCK Period
20
ns
tSTAP
TDI, TMS Setup Before TCK High
5
ns
tHTAP
TDI, TMS Hold After TCK High
6
ns
tSSYS
System Inputs Setup Before TCK High1
7ns
tHSYS
System Inputs Hold After TCK High1
8ns
tTRSTW
TRST Pulse Width
4tCK
ns
Switching Characteristics
tDTDO
TDO Delay from TCK Low
7
ns
tDSYS
System Outputs Delay After TCK Low
2
10
ns
1 System Inputs = AD15–0, SPIDS, CLKCFG1–0, RESET, BOOTCFG1–0, MISO, MOSI, SPICLK, DAI_Px, and FLAG3–0.
2 System Outputs = MISO, MOSI, SPICLK, DAI_Px, AD15–0, RD, WR, FLAG3–0, CLKOUT, EMU, and ALE.
Figure 27. JTAG Test Access Port and Emulation
TCK
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
tSTAP
tTCK
tHTAP
tDTDO
tSSYS
tHSYS
tDSYS
相關PDF資料
PDF描述
ADSP-BF531SBBCZ4RL IC DSP CTLR 16BIT 400MHZ 160-CSP
MAX6504UKP005+T IC TEMP SWITCH SOT23-5
TPSB476K010A0250 CAP TANT 47UF 10V 10% 1210
TPSB476K006H0500 CAP TANT 47UF 6.3V 10% 1210
VI-B63-EU-B1 CONVERTER MOD DC/DC 24V 200W
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