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參數(shù)資料
| 型號(hào)： | AD9877ABSZ |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 33/36頁(yè) |
| 文件大小： | 0K |
| 描述： | IC PROCESSOR FRONT END 100MQFP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 位數(shù)： | 12 |
| 通道數(shù)： | 3 |
| 功率（瓦特）： | 1.17W |
| 電壓 - 電源，模擬： | 3.3V |
| 電壓 - 電源，數(shù)字： | 3.3V |
| 封裝/外殼： | 100-BQFP |
| 供應(yīng)商設(shè)備封裝： | 100-MQFP（14x20） |
| 包裝： | 托盤(pán) |
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AD9877
Rev. B | Page 6 of 36
Parameter
Temp
Test
Level
Min
Typ
Max
Unit
TIMING CHARACTERISTICS (10 pF Load)
Wake-Up Time
N/A
200
tMCLK cycles
Minimum RESET Pulse Width Low (tRL)
N/A
5
tMCLK cycles
Digital Output Rise/Fall Time
Full
II
2.8
4
ns
Tx/Rx Interface
MCLK Frequency (fMCLK)
Full
II
66
MHz
TxSYNC/TxIQ Setup Time (tSU)
Full
II
3
ns
TxSYNC/TxIQ Hold Time (tHD)
Full
II
3
ns
MCLK Rising Edge to RxSYNC/RxIQ/IF Valid Delay (tMD)
Full
II
0
1.0
ns
REFCLK Rising or Falling Edge to RxSYNC/RxIQ/IF Valid
Delay (tOD)
Full
II
TOSC/4 2.0
TOSC/4 + 3.0
ns
REFCLK Edge to MCLK Falling Edge (tEE)
Full
II
1.0
+1.0
ns
Serial Control Bus
Maximum SCLK Frequency (fSCLK)
Full
II
15
MHz
Minimum Clock Pulse Width High (tPWH)
Full
II
30
ns
Minimum Clock Pulse Width Low (tPWL)
Full
II
30
ns
Maximum Clock Rise/Fall
Full
II
1
μs
Minimum Data/Chip-Select Setup Time (tDS)
Full
II
25
ns
Minimum Data Hold Time (tDH)
Full
II
0
ns
Maximum Data Valid Time (tDV)
Full
II
30
ns
CMOS LOGIC INPUTS
Logic 1 Voltage
25°C
II
DRVDD 0.7
V
Logic 0 Voltage
25°C
II
0.4
V
Logic 1 Current
25°C
II
12
μA
Logic 0 Current
25°C
II
12
μA
Input Capacitance
25°C
III
3
pF
CMOS LOGIC OUTPUTS (1 mA Load)
Logic 1 Voltage
25°C
II
DRVDD 0.6
V
Logic 0 Voltage
25°C
II
0.4
V
POWER SUPPLY
Supply Current, IS (Full Operation)
25°C
II
233
272
mA
Analog Supply Current, IAS
25°C
III
85
mA
Digital Supply Current, IDS
25°C
III
228
mA
Supply Current, IS
Standby (PWRDN Pin Active)
25°C
I
104
113
mA
Full Power-Down (Register 0x02 = 0xF9)
25°C
III
10
mA
Power-Down Tx Path (Register 0x02 = 0x20)
25°C
III
60
mA
Power-Down Rx Path (Register 0x02 = 0x19)
25°C
III
265
mA
Reset (RESET Pin Active)
25°C
III
85
mA
Power Supply Rejection (Differential Signal)
Tx DAC
25°C
III
<0.25
% FS
8-Bit ADC
25°C
III
<0.004
% FS
12-Bit ADC
25°C
III
<0.0004
% FS
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AD9878BSTZ | IC FRONT-END MIXED-SGNL 100-LQFP |
| AD9879BSZ | IC PROCESSOR FRONT END 100MQFP |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| AD9877-EB | 制造商:Analog Devices 功能描述: |
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| AD9878BST | 制造商:Analog Devices 功能描述:Mixed Signal Front End 100-Pin LQFP |
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