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參數(shù)資料
| 型號： | AD9548/PCBZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 93/112頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD EVAL FOR AD9548 |
| 產品變化通告： | AD9548 Mask Change 20/Oct/2010 |
| 設計資源： | AD9548 Schematic AD9548 BOM AD9548 Eval Brd Layers |
| 標準包裝： | 1 |
| 主要目的： | 計時，時鐘發(fā)生器 |
| 嵌入式： | 否 |
| 已用 IC / 零件： | AD9548 |
| 主要屬性： | 62.5 ~ 450 MHz 輸出頻率 |
| 次要屬性： | SPI 和 I2C 兼容控制端口 |
| 已供物品： | 板 |
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Data Sheet
AD9548
Rev. E | Page 81 of 112
Table 74. Q3 Divider1
Address
Bits
Bit Name
Description
0x0414
[7:0]
Q3
Q3 divider, Bits[7:0]
0x0415
[7:0]
Q3 divider, Bits[15:8]
0x0416
[7:0]
Q3 divider, Bits[23:16]
0x0417
[7:6]
Unused
[5:0]
Q3
Q3 divider, Bits[29:24]
1
The default value is 0 (or divide by 1).
REFERENCE INPUT CONFIGURATION (REGISTER 0x0500 TO REGISTER 0x0507)
Table 75. Reference Power-Down
When all bits are set, the reference receiver section enters a deep sleep mode.
Address
Bits
Bit Name
Description
0x0500
[7]
Ref DD power-down
REF DD input receiver power-down
0 (default) = normal operation
1 = power-down
[6]
Ref D power-down
REF D input receiver power-down
0 (default) = normal operation
1 = power-down
[5]
Ref CC power-down
REF CC input receiver power-down
0 (default) = normal operation
1 = power-down
[4]
Ref C power-down
REF C input receiver power-down
0 (default) = normal operation
1 = power-down
[3]
Ref BB power-down
REF BB input receiver power-down
0 (default) = normal operation
1 = power-down
[2]
Ref B power-down
REF B input receiver power-down
0 (default) = normal operation
1 = power-down
[1]
Ref AA power-down
REF AA input receiver power-down
0 (default) = normal operation
1 = power-down
[0]
Ref A power-down
REF A input receiver power-down
0 (default) = normal operation
1 = power-down
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