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參數(shù)資料
| 型號： | μPD424210 |
| 廠商： | NEC Corp. |
| 英文描述： | 16 bits CMOS Dynamic RAM with Optional EDO.(16M 同步動態(tài)RAM) |
| 中文描述： | 16位的CMOS動態(tài)隨機存儲器的任擇易都。（1,600同步動態(tài)RAM）的 |
| 文件頁數(shù)： | 35/48頁 |
| 文件大?。?/td> | 351K |
| 代理商： | ΜPD424210 |
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μ
PD424210
35
Hyper Page Mode (EDO) Byte Late Write Cycle
RAS
V
IH–
V
IL–
t
RASP
UCAS
V
IH–
V
IL–
U I/O
Hi - Z
V
IH–
V
IL–
t
RP
t
RHCP
t
RSH
t
HCAS
t
HPC
t
CSH
t
RCD
t
CRP
t
HCAS
t
CPN
LCAS
V
IH–
V
IL–
t
CRP
t
MRH
t
CP
t
HCAS
t
CP
Address
V
IH–
V
IL–
OE
V
IH–
V
IL–
L I/O
V
IH–
V
IL–
Data in
t
OED
Hi - Z
Hi - Z
t
DH
Hi - Z
Data in
t
OED
t
OED
Hi - Z
Hi - Z
Data in
t
OED
t
DS
t
OED
t
DS
t
DH
t
OED
t
DS
t
DH
t
OEH
t
OEH
t
OEH
t
WP
t
RCS
t
CWL
t
CWL
t
RCS
t
WP
Row
Col.
Col.
Col.
t
RWL
t
CWL
t
WP
t
RCS
t
RAL
t
CAH
t
ASC
t
CAH
t
ASC
t
CAH
t
ASC
t
RAH
t
ASR
t
RAD
WE
V
IH–
V
IL–
Remarks 1.
In the hyper page mode (EDO), read, write and read modify write cycles are available for each of
the consecutive CAS cycles within the same RAS cycle.
2.
This cycle can be used to control either UCAS or LCAS only. Or, it can be used to control UCAS
or LCAS simultaneously, or at random.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| μPD481850 | Synchronous Graphics Memory (SGRAM)(8M 同步圖形存儲器) |
| μPD784224 | 16 Bit Single Chip Microcontrollers(16 位單片微控制器) |
| μPD784225 | 16 Bit Single Chip Microcontrollers(16 位單片微控制器) |
| μPD784225Y | 16 Bit Single Chip Microcontrollers(16 位單片微控制器) |
| μPD78F4216Y | 8/16 Bit RISC Microcontrollers(8/16位RISC微控制器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PD42-CAMG13 | 制造商:P-TEC 制造商全稱:P-tec Corporation 功能描述:Three Digit 7 Segment 0.56” Display |
| PD42-CAMO12 | 制造商:P-TEC 制造商全稱:P-tec Corporation 功能描述:Three Digit 7 Segment 0.56” Display |
| PD42-CAMR21 | 制造商:P-TEC 制造商全稱:P-tec Corporation 功能描述:Three Digit 7 Segment 0.56” Display |
| PD42-CAMR24 | 制造商:P-TEC 制造商全稱:P-tec Corporation 功能描述:Three Digit 7 Segment 0.56” Display |
| PD42-CAMY01 | 制造商:P-TEC 制造商全稱:P-tec Corporation 功能描述:Three Digit 7 Segment 0.56” Display |
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