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參數(shù)資料
| 型號(hào)： | μPD30101 |
| 廠商： | NEC Corp. |
| 英文描述： | 64-Bit Microprocessor(64位微處理器) |
| 中文描述： | 64位微處理器（64位微處理器） |
| 文件頁(yè)數(shù)： | 84/359頁(yè) |
| 文件大?。?/td> | 1652K |
| 代理商： | ΜPD30101 |
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CHAPTER 4 MEMORY MANAGEMENT SYSTEM
The V
R
4101 provides a memory management unit (MMU) which uses a translation lookaside buffer
(TLB) to translate virtual addresses into physical addresses. This chapter describes the virtual and
physical address spaces, the virtual-to-physical address translation, the operation of the TLB in making
these translations, and the CP0 registers that provide the software interface to the TLB.
4.1 TRANSLATION LOOKASIDE BUFFER (TLB)
Virtual addresses are translated into physical addresses using an on-chip TLB
fully-associative memory that holds 32 entries, which provide mapping to 32 odd/even page pairs for
one entry. The pages can have five different sizes, 1 K, 4 K, 16 K, 64 K, and 256 K. If it is supplied
with a virtual address, each of the 32 TLB entries is checked simultaneously to see whether they match
the virtual addresses that are provided with the ASID field and saved in the EntryHi register.
Note
. The on-chip TLB is a
Note
Virtual addresses may be converted to physical addresses without using a TLB, depending on
the address space that is being subjected to address translation. For example, address
translation for the kseg0 or kseg1 address space does not use mapping. The physical
addresses of these address spaces are determined by subtracting the base address of the
address space from the virtual addresses.
4.1.1 Hits and Misses
If there is a virtual address match, or “hit,” in the TLB, the physical page number is extracted from the
TLB and concatenated with the offset to form the physical address.
If no match occurs (TLB “miss”), an exception is taken and software refills the TLB from the page table
resident in memory. The software writes to an entry selected using the Index register or a random entry
indicated in the Random register.
4.1.2 Multiple Hit
If more than one entry in the TLB matches the virtual address being translated, the operation is
undefined and the TLB may be disabled. In this case, the TLB-Shutdown (TS) bit of the Status register
is set to 1, and the TLB becomes unusable (an attempt to access the TLB results in a TLB Mismatch
exception regardless of whether there is an entry that hits). The TS bit can be cleared only by a reset.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| μPD30102 | 64-/32-BIT Microprocessor(64/32位微處理器) |
| μPD30121 | 64-Bit MIPS RISC Microprocessor(64 位RISC 微處理器) |
| μPD30122 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
| μPD30181 | 64-Bit RISC Microprosessor(64位RISC微處理器) |
| μPD30210 | 64-Bit MIPS RISC Microprocessor(64位MIPS RISC 微處理器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PD301-024-03-PC | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:Analog IC |
| PD301-024-03-P-C-200 | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-250 | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-P-C-300 | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:DC to DC Converter |
| PD301-024-03-PI | 制造商:未知廠家 制造商全稱(chēng):未知廠家 功能描述:Analog IC |
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