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參數(shù)資料
| 型號(hào)： | XRT83SL30IVTR-F |
| 廠商： | Exar Corporation |
| 文件頁(yè)數(shù)： | 70/76頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU T1/E1/J1 SGL 64TQFP |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 類(lèi)型： | 線路接口裝置（LIU） |
| 驅(qū)動(dòng)器/接收器數(shù)： | 1/1 |
| 規(guī)程： | T1，E1，J1 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 64-LQFP |
| 供應(yīng)商設(shè)備封裝： | 64-TQFP（10x10） |
| 包裝： | 帶卷 (TR) |
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XRT83SL30
69
SINGLE-CHANNEL T1/E1/J1 SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
REV. 1.0.1
0.66
-0.2V
1.16
0.05V
0.93
-0.05V
1.16
-0.05V
TABLE 47: AC ELECTRICAL CHARACTERISTICS
(TA=25°C, VDD=3.3V±5%, UNLESS OTHERWISE SPECIFIED)
PARAMETER
SYMBOL
MIN
TYP
MAX
UNITS
E1 MCLK Clock Frequency
-
2.048
-
MHz
T1 MCLK Clock Frequency
-
1.544
-
MHz
MCLK Clock Duty Cycle
40
-
60
%
MCLK Clock Tolerance
-
±50
-
ppm
TCLK Duty Cycle
TCDU
30
50
70
%
Transmit Data Setup Time
TSU
50
-
ns
Transmit Data Hold Time
THO
30
-
ns
TCLK Rise Time(10%/90%)
TCLKR
-
40
ns
TCLK Fall Time(90%/10%)
TCLKF
-
40
ns
RCLK Duty Cycle
RCDU
45
50
55
%
Receive Data Setup Time
RSU
150
-
ns
Receive Data Hold Time
RHO
150
-
ns
RCLK to Data Delay
RDY
-
40
ns
RCLK Rise Time(10%/90%) with
25pF Loading.
RCLKR
-
40
ns
RCLK Fall Time(90%/10%) with 25pF
Loading.
RCLKF
40
ns
TABLE 46: DSX1 INTERFACE ISOLATED PULSE MASK AND CORNER POINTS
MINIMUM CURVE
MAXIMUM CURVE
TIME (UI)
NORMALIZED AMPLITUDE
TIME (UI)
NORMALIZED AMPLITUDE
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