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參數(shù)資料
| 型號： | XRT83SH38IB-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 16/78頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU SH T1/E1/J1 8CH 225BGA |
| 標準包裝： | 84 |
| 類型： | 線路接口裝置（LIU） |
| 驅(qū)動器/接收器數(shù)： | 8/8 |
| 規(guī)程： | T1，E1，J1 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 225-BGA |
| 供應商設備封裝： | 225-BGA（19x19） |
| 包裝： | 托盤 |
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XRT83SH38
20
REV. 1.0.7
8-CHANNEL T1/E1/J1 SHORT-HAUL LINE INTERFACE UNIT
2.0 MASTER CLOCK GENERATOR
Using a variety of external clock sources, the on-chip frequency synthesizer generates the T1 (1.544MHz) or
E1 (2.048MHz) master clocks necessary for the transmit pulse shaping and receive clock recovery circuit.
There are two master clock inputs MCLKE1 and MCLKT1. In systems where both T1 and E1 master clocks are
available these clocks can be connected to the respective pins. All channels of a given XRT83SH38 must be
operated at the same clock rate, either T1, E1 or J1 modes. In systems that have only one master clock
source available (E1 or T1), that clock should be connected to both MCLKE1 and MCLKT1 inputs for proper
operation. T1 or E1 master clocks can be generated from 8kHz, 16kHz, 56kHz, 64kHz, 128kHz and 256kHz
external clocks under the control of CLKSEL[2:0] inputs according to EQC[4:0] determine the T1/E1 operating
mode. See for details.
FIGURE 3. TWO INPUT CLOCK SOURCE
FIGURE 4. ONE INPUT CLOCK SOURCE
TABLE 2: MASTER CLOCK GENERATOR
MCLKE1
K
HZ
MCLKT1
K
HZ
CLKSEL2
CLKSEL1
CLKSEL0
MCLKRATE
MASTER CLOCK
K
HZ
2048
0
2048
0
1
1544
2048
1544
0
2048
1544
0
1
1544
0
1
0
2048
1544
0
1
1544
8
x
0
1
0
2048
8
x
0
1
0
1
1544
MCLKE1
MCLKT1
MCLKOUT
1.544MHz
or
2.048MHz
+/-50ppm
1.544MHz
+/-50ppm
Two Input Clock Sources
MCLKE1
MCLKT1
MCLKOUT
1.544MHz
or
2.048MHz
One Input Clock Source
Input Clock Options
8kHz
16kHz
56kHz
64kHz
128kHz
256kHz
1.544MHz
2.048MHz
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PDF描述 |
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