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參數(shù)資料
| 型號： | XRD98L63AIV-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 8/41頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CCD DIGITIZER 12BIT 48TQFP |
| 標(biāo)準(zhǔn)包裝： | 250 |
| 位數(shù)： | 12 |
| 通道數(shù)： | 1 |
| 電壓 - 電源，模擬： | 2.7 V ~ 3.6 V |
| 電壓 - 電源，數(shù)字： | 2.7 V ~ 3.6 V |
| 封裝/外殼： | 48-TQFP |
| 供應(yīng)商設(shè)備封裝： | 48-TQFP（7x7） |
| 包裝： | 托盤 |
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XRD98L63
16
Rev.1.01
One Volt Input Option
The CDS amp is designed to normally handle a maxi-
mum signal of 800mV (V
BLACK - VVIDEO). The One Volt
option allows the CDS amp to handle up to 1.0V with no
distortion. The One Volt option is enabled by writing a
1 to the "OneV" bit in the Control register.
Programmable Gain Amplifier (PGA)
The PGA provides gains from 6 dB to 36 dB in
approximately 0.047 dB steps. The desired gain set-
ting is programmed via the 10 bit gain register in the
Serial Interface.
For gain codes between 0 and 639, the gain can be
calculated by the following equation:
6
30
640
]
dB
Gain[
+
×
=
Code
For gain codes
≥ 640, the gain is fixed at 36 dB. The
gain increases by 6dB (a factor of 2x) every 128 codes.
This should help simplify DSP algorithms and control.
Figure 7. PGA Gain vs. Gain Code
An example of setting the gain is as follows: if the CCD
input is limited to 800mVpp (CDSVIN) and the ADC full
scale differential input (VID) is 1.8Vpp, then a mini-
mum gain is calculated by:
The gain code would be set to 22 (decimal) for a PGA
gain of 7.03 dB.
Gain code, PGA00[9:0]
PGA
ga
in
[dB]
0
1024
512
256
6
12
18
24
30
36
128
384
640
dB
04
.
7
V
8
.
0
V
8
.
1
log
20
log
20
Gain
=
=
=
CDSVin
VID
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