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參數(shù)資料
| 型號： | XRD98L63AIV-F |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 26/41頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CCD DIGITIZER 12BIT 48TQFP |
| 標準包裝： | 250 |
| 位數(shù)： | 12 |
| 通道數(shù)： | 1 |
| 電壓 - 電源，模擬： | 2.7 V ~ 3.6 V |
| 電壓 - 電源，數(shù)字： | 2.7 V ~ 3.6 V |
| 封裝/外殼： | 48-TQFP |
| 供應(yīng)商設(shè)備封裝： | 48-TQFP（7x7） |
| 包裝： | 托盤 |
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XRD98L63
32
Rev.1.01
0
1
0
1
0
1
4
1
2
3
4
5
1
2
3
0
1
0
1
0
1
0
FSYNC
EOS
CCD
PBLK
CAL
CLAMP
* Line Pattern
Select
Exar
Name
TG
Signal
Name
VD
ID
PBLK
OBCLP
CLPDM
1) PBLK latches EOS value into Line Pattern Select.
1)
Frame "N"
Frame "N+1"
CONDITIONS: FSYNCpol=0, PBLKpol=0, CALpol=0, CLAMPpol=0, EOSpol=1
* Internal signals
(Sony Progressive mode)
FSYNC
EOS
CCD
PBLK
CAL
CLAMP
4
1
2
3
4
5
1
2
3
* Line Pattern
Select
0
1
0
1
0
1
0
Exar
Name
TG
Signal
Name
VD
HD
PBLK
CPOB
MGstart = 0
1) FSYNC resets Line Pattern Select to "MGstart" bit value.
2) PBLK toggles Line Pattern Select value.
1)
2)
HCLR/CLPD
CONDITIONS: FSYNCpol=1, PBLKpol=1, CALpol=1, CLAMPpol=1, EOSpol=1
* Internal signals
(Panasonic Progresive mode)
MGstart = 1
Figure 25. Multiple Gain Mode Timing, Progressive, MGsel[1:0] = 01
Figure 26. Multiple Gain Mode Timing, Progressive, MGsel[1:0] = 11
MGsel
Functions
00
Sony Interlaced
01
Sony Progressive
10
Panasonic Interlaced
11
Panasonic Progressive
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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