參數(shù)資料
型號(hào)： UPD70F3306GC-8BT
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP80
封裝： 14 X 14 MM, PLASTIC, TQFP-80
文件頁(yè)數(shù)： 585/755頁(yè)
文件大?。?/td> 4717K
代理商： UPD70F3306GC-8BT
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628
SAM G51 [DATASHEET]
11209C–ATARM–20-Dec-13
10-bit Slave Addressing
For a slave address higher than 7 bits, the user must configure the address size (IADRSZ) and set the other slave
address bits in the Internal Address Register (TWI_IADR). The two remaining Internal address bytes, IADR[15:8] and
IADR[23:16] can be used the same as in 7-bit Slave Addressing.
Example: Address a 10-bit device (10-bit device address is b1 b2 b3 b4 b5 b6 b7 b8 b9 b10)
1.
Program IADRSZ = 1,
2.
Program DADR with 1 1 1 1 0 b1 b2 (b1 is the MSB of the 10-bit address, b2, etc.)
3.
Program TWI_IADR with b3 b4 b5 b6 b7 b8 b9 b10 (b10 is the LSB of the 10-bit address)
Figure 28-14 below shows a byte write to an Atmel AT24LC512 EEPROM. This demonstrates the use of internal
addresses to access the device.
Figure 28-14.
Internal Address Usage
28.7.3.7
Using the Peripheral DMA Controller (PDC)
The use of the PDC significantly reduces the CPU load.
To assure correct implementation, respect the following programming sequences:
Data Transmit with the PDC
1.
Initialize the transmit PDC (memory pointers, transfer size - 1).
2.
Configure the master (DADR, CKDIV, etc.) or slave mode.
3.
Start the transfer by setting the PDC TXTEN bit.
4.
Wait for the PDC ENDTX Flag either by using the polling method or ENDTX interrupt.
5.
Disable the PDC by setting the PDC TXTDIS bit.
6.
Wait for the TXRDY flag in TWI_SR.
7.
Set the STOP command in TWI_CR.
8.
Write the last character in TWI_THR.
9.
(Optional) Wait for the TXCOMP flag in TWI_SR before disabling the peripheral clock if required.
Data Receive with the PDC
The PDC transfer size must be defined with the buffer size minus 2. The two remaining characters must be managed
without PDC to ensure that the exact number of bytes are received whatever the system bus latency conditions
encountered during the end of buffer transfer period.
In slave mode, the number of characters to receive must be known in order to configure the PDC.
1.
Initialize the receive PDC (memory pointers, transfer size - 2).
2.
Configure the master (DADR, CKDIV, etc.) or slave mode.
3.
Set the PDC RXTEN bit.
4.
(Master Only) Write the START bit in the TWI_CR to start the transfer.
5.
Wait for the PDC ENDRX Flag either by using polling method or ENDRX interrupt.
6.
Disable the PDC by setting the PDC RXTDIS bit.
7.
Wait for the RXRDY flag in TWI_SR.
8.
Set the STOP command in TWI_CR.
9.
Read the penultimate character in TWI_RHR.
S
T
A
R
T
M
S
B
Device
Address
0
L
S
B
R
/
W
A
C
K
M
S
B
W
R
I
T
E
A
C
K
A
C
K
L
S
B
A
C
K
FIRST
WORD ADDRESS
SECOND
WORD ADDRESS
DATA
S
T
O
P
相關(guān)PDF資料
PDF描述
UPD70F3345GJ(A)-GAE-AX 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144
UPD70F3357GJ(A)-GAE-AX 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144
UPD70F3347GJ 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144
UPD70F3454F1-DA9-A 32-BIT, FLASH, 64 MHz, RISC MICROCONTROLLER, PBGA161
UPD71087G 71087 SERIES, 8-BIT TRANSCEIVER, INVERTED OUTPUT, PDSO20
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
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