參數(shù)資料
型號： UPD70F3306GC-8BT
元件分類： 微控制器/微處理器
英文描述： 32-BIT, FLASH, 20 MHz, RISC MICROCONTROLLER, PQFP80
封裝： 14 X 14 MM, PLASTIC, TQFP-80
文件頁數(shù)： 46/755頁
文件大?。?/td> 4717K
代理商： UPD70F3306GC-8BT
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Preliminary User’s Manual U16895EJ1V0UD
14
CHAPTER 18 I
2C BUS .......................................................................................................................... 511
18.1
Features .................................................................................................................................... 511
18.2
Configuration............................................................................................................................ 514
18.3
Registers ................................................................................................................................... 516
18.4
Functions .................................................................................................................................. 529
18.4.1
Pin configuration .......................................................................................................................... 529
18.5
I
2C Bus Definitions and Control Methods .............................................................................. 530
18.5.1
Start condition.............................................................................................................................. 530
18.5.2
Addresses.................................................................................................................................... 531
18.5.3
Transfer direction specification .................................................................................................... 531
18.5.4
Acknowledge signal (ACK) .......................................................................................................... 532
18.5.5
Stop condition .............................................................................................................................. 533
18.5.6
Wait signal (WAIT) ....................................................................................................................... 534
18.6
I
2C Interrupt Request Signals (INTIIC0) .................................................................................. 536
18.6.1
Master device operation............................................................................................................... 536
18.6.2
Slave device operation (when receiving slave address data (match with address)) .................... 539
18.6.3
Slave device operation (when receiving extension code) ............................................................ 543
18.6.4
Operation without communication................................................................................................ 547
18.6.5
Arbitration loss operation (operation as slave after arbitration loss) ............................................ 547
18.6.6
Operation when arbitration loss occurs (no communication after arbitration loss) ....................... 549
18.7
Interrupt Request Signal (INTIIC0) Generation Timing and Wait Control........................... 554
18.8
Address Match Detection Method .......................................................................................... 555
18.9
Error Detection ......................................................................................................................... 555
18.10 Extension Code ........................................................................................................................ 556
18.11 Arbitration ................................................................................................................................. 557
18.12 Wakeup Function ..................................................................................................................... 558
18.13 Communication Reservation .................................................................................................. 559
18.13.1 When communication reservation function is enabled (IICF0.IICRSV0 bit = 0) ........................... 559
18.13.2 When communication reservation function is disabled (IICF0.IICRSV0 bit = 1) .......................... 562
18.14 Cautions .................................................................................................................................... 563
18.15 Communication Operations .................................................................................................... 563
18.15.1 Master operation 1 ....................................................................................................................... 563
18.15.2 Master operation 2 ....................................................................................................................... 565
18.15.3 Slave operation............................................................................................................................ 566
18.16 Timing of Data Communication .............................................................................................. 569
CHAPTER 19 INTERRUPT/EXCEPTION PROCESSING FUNCTION............................................... 576
19.1
Overview ................................................................................................................................... 576
19.1.1
Features....................................................................................................................................... 576
19.2
Non-Maskable Interrupts ......................................................................................................... 579
19.2.1
Operation ..................................................................................................................................... 582
19.2.2
Restore ........................................................................................................................................ 583
19.2.3
NP flag ......................................................................................................................................... 584
19.3
Maskable Interrupts ................................................................................................................. 585
19.3.1
Operation ..................................................................................................................................... 585
19.3.2
Restore ........................................................................................................................................ 587
19.3.3
Priorities of maskable interrupts................................................................................................... 588
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PDF描述
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